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EDA365电子论坛网»电子社区 › EDA工具&PCB设计 › Cadence Allegro论坛 › 请教设置等长规则的问题
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请教设置等长规则的问题

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gavinhuang
  • TA的每日心情
    慵懒
    2022-4-7 15:32

    • 签到天数: 27 天

    [LV.4]偶尔看看III
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    1#
    发表于 2017-9-15 15:12 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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    x
    8 k( T' p+ L# C1 g6 T$ t

    & ~/ C% D# o" [如下图所示，下图是某公版的设计，DDR4的控制/地址信号从主控芯片U1连到内存颗粒U150和U153，fly-by的拓扑（信号先连到U150再连到U153）。, s! Y' h% N3 W/ m* k( u
      d5 \7 q5 d9 r
    在Constraint Manager的Relative Propagation Delay里需要设置所有控制/地址信号分别到U150和U153时等长，怎样才能像下图那样把所有U1到U150的长度挑出来，然后U1到U153的长度挑出来？
    % F1 H; @9 K7 h. G1 e2 l0 Q2 {8 I4 v2 R8 p& F& |7 W1 V# L
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    紫菁

    该用户从未签到
    2#
    发表于 2017-9-15 15:43 | 只看该作者
    pinpair设规则的时候就设好

    点评

    gavinhuang
    谢谢你的回答！ 是挨个网络设置pin pair，然后再把到相同芯片的pin pair归到同一个Match Group吗？ 网络数量比较多，有没有批量设置pin pair的办法？我没找到批量设置的办法 [attachimg]130756[/attachimg]  详情 回复 发表于 2017-9-15 17:02

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    paul_iw

    该用户从未签到
    3#
    发表于 2017-9-15 16:33 | 只看该作者
    先设置PIN pair

    点评

    gavinhuang
    谢谢你的回答！ 是挨个网络设置pin pair，然后再把到相同芯片的pin pair归到同一个Match Group吗？ 网络数量比较多，有没有批量设置pin pair的办法？我没找到批量设置的办法 [attachimg]130757[/attachimg]  详情 回复 发表于 2017-9-15 17:03

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    gavinhuang
  • TA的每日心情
    慵懒
    2022-4-7 15:32

    • 签到天数: 27 天

    [LV.4]偶尔看看III
    4#
     楼主| 发表于 2017-9-15 17:02 | 只看该作者
    紫菁 发表于 2017-9-15 15:43
    " j. T: W3 H" \( v* Z8 w4 Opinpair设规则的时候就设好
    * ]( [4 c7 \( [& T7 q' {+ z2 T
    谢谢你的回答！ 是挨个网络设置pin pair，然后再把到相同芯片的pin pair归到同一个Match Group吗？/ E" }% D/ [8 |) }2 M
    ' g/ D" @; e6 q& N' u3 s1 a, c
    网络数量比较多，有没有批量设置pin pair的办法？我没找到批量设置的办法+ F# A7 o' Q  M6 O& W# k
    + C4 q: \/ V# I1 i
    1 x' \! B7 D8 c

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    gavinhuang
  • TA的每日心情
    慵懒
    2022-4-7 15:32

    • 签到天数: 27 天

    [LV.4]偶尔看看III
    5#
     楼主| 发表于 2017-9-15 17:03 | 只看该作者
    paul_iw 发表于 2017-9-15 16:33% j) i$ W& k) I1 i/ c
    先设置PIN pair
    / s# J( @8 `$ V2 t
    谢谢你的回答！ 是挨个网络设置pin pair，然后再把到相同芯片的pin pair归到同一个Match Group吗？
    ' Q# `* P8 J7 t6 b
    4 l8 _- o" L+ v& m6 A网络数量比较多，有没有批量设置pin pair的办法？我没找到批量设置的办法! s1 d( R8 a% X6 x/ F* U2 Q

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    paul_iw

    该用户从未签到
    6#
    发表于 2017-9-15 17:07 | 只看该作者
    在没有skill可用的时候，只能手动一个个设置了

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    gavinhuang
    好吧，谢谢你！  详情 回复 发表于 2017-9-15 17:17

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    gavinhuang
  • TA的每日心情
    慵懒
    2022-4-7 15:32

    • 签到天数: 27 天

    [LV.4]偶尔看看III
    7#
     楼主| 发表于 2017-9-15 17:17 | 只看该作者
    paul_iw 发表于 2017-9-15 17:07
    ) z/ s. x3 F* N4 a8 V/ r4 a3 G8 @3 M& ~在没有skill可用的时候，只能手动一个个设置了

    . A  X& M" ^- h9 \8 ^/ f2 s7 Y( w: {( ?5 R 好吧，谢谢你！% T3 G$ e, O  d

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    ACE_ASL
    类似这个样子，这个是地址线的  详情 回复 发表于 2017-9-15 18:51
    ACE_ASL
    在Electrical约束里找一个你要设pinpar的net然后右键最下面有个SigXplorer,点击进去，然后set 里有个Constraint点下进去，然后再点Rel Prop Delay，在这里你可以设置多个pin-pin的等长拓扑，设置好之后保存更新到约  详情 回复 发表于 2017-9-15 18:43

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    ACE_ASL
  • TA的每日心情
    无聊
    2023-11-1 15:41

    • 签到天数: 1 天

    [LV.1]初来乍到
    8#
    发表于 2017-9-15 18:43 | 只看该作者
    gavinhuang 发表于 2017-9-15 17:17# m) m3 e. w9 s* |
    好吧，谢谢你！

    0 Q4 {$ w# N" h" ^5 d在Electrical约束里找一个你要设pinpar的net然后右键最下面有个SigXplorer,点击进去，然后set 里有个Constraint点下进去，然后再点Rel Prop Delay，在这里你可以设置多个pin-pin的等长拓扑，设置好之后保存更新到约束里，然后再到约束里找到和这个net拓扑相同的其它所有net，比如说所有的DDR data，然后加入到你刚才创建的那个拓扑就可以批量设置pin-pair的等长了data和地址因为拓扑不一样，要各找一个net建拓扑约束，不知道你能否看明白哦，可以网上找找教程# i2 L* O* p3 z
    & q! C3 S$ j# I  [  f

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    gavinhuang
    能看明白，谢谢你！ 如下图，由于U1->U8->U9之后还有一个端接电阻，有些net会出错，把到电阻的pin pair分到MGrp里，还删不掉，有什么好办法吗？ [attachimg]130900[/attachimg] [attachimg]130899[/attachi  详情 回复 发表于 2017-9-19 09:34

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    ACE_ASL
  • TA的每日心情
    无聊
    2023-11-1 15:41

    • 签到天数: 1 天

    [LV.1]初来乍到
    9#
    发表于 2017-9-15 18:51 | 只看该作者
    gavinhuang 发表于 2017-9-15 17:17" @3 J2 X% r: U+ M: Y" W9 n+ }
    好吧，谢谢你！

    9 y; U; [& M! k5 p1 V) r类似这个样子，这个是地址线的& P9 {: a9 C% v5 r9 {. [

    $1A60C2AA470518D.jpg (56.26 KB, 下载次数: 2)

    $1A60C2AA470518D.jpg

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    泡泡_X84gB

    该用户从未签到
    10#
    发表于 2017-9-18 10:01 | 只看该作者
    看来学习的还很多
    * K. n; W* _" A. A6 C

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    gavinhuang
  • TA的每日心情
    慵懒
    2022-4-7 15:32

    • 签到天数: 27 天

    [LV.4]偶尔看看III
    11#
     楼主| 发表于 2017-9-19 09:34 | 只看该作者
    ACE_ASL 发表于 2017-9-15 18:43
    . r8 H. m; t) |. |7 h3 X3 }在Electrical约束里找一个你要设pinpar的net然后右键最下面有个SigXplorer,点击进去，然后set 里有个Cons ...
    - n% k+ j  w7 A
    能看明白，谢谢你！: N$ Z( }3 m) d' p$ U
    5 y; W6 W% R8 M. o8 j  f
    如下图，由于U1->U8->U9之后还有一个端接电阻，有些net会出错，把到电阻的pin pair分到MGrp里，还删不掉，有什么好办法吗？
    9 R& C( [5 \8 |! d8 {5 `8 B' @5 L- X7 T, l9 V  d* T3 M

      m; H& Z# X; V1 k0 a& b2 l0 u3 e: {4 J' d7 L

    , K1 g  I5 T' v

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    65770096

    该用户从未签到
    12#
    发表于 2017-9-20 10:16 | 只看该作者
    出错的在到SigXplorer里重新建一个ecset，mg设置同一个名字就好，地址线拓扑不一样经常有这个问题。

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    AD9_PCB

    该用户从未签到
    13#
    发表于 2017-9-30 11:43 | 只看该作者
    sig不方便其实，乱匹配，比如你想所有的一组，它偏分四组，T点是这样的，烦

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