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楼主: EDA365QA
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2017年9月25日QA检查报告节选

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17#
发表于 2017-9-27 09:32 | 只看该作者
传道受业解惑
3 \0 }8 U' Q8 z  C

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19#
发表于 2017-10-16 18:18 | 只看该作者
EDA365QA 发表于 2017-9-26 09:05
1 Q6 a- M8 t& d5 H6.光耦前后隔离
/ K& s- o8 S% u

# T9 d9 c/ E' Z; J1 }+ r3 @9 [8 h) o

该用户从未签到

20#
发表于 2017-10-17 08:49 | 只看该作者
EDA365QA 发表于 2017-9-26 09:05, G9 _/ e) }1 [% S9 J
4.时钟测试点不要加在末端

  P- ?7 s1 |" p6 S) Y6 m' X时钟测试点 应该怎么加?
( H! E; |/ d6 V& [" ?1 r

点评

最好加路径上  详情 回复 发表于 2018-1-15 15:21
pcb
测试点应加在布线的路上.  详情 回复 发表于 2017-10-17 13:58

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21#
发表于 2017-10-17 13:58 | 只看该作者
bingshuihuo 发表于 2017-10-17 08:49
3 ?. ~% z! O+ C1 L1 e时钟测试点 应该怎么加?

- I6 X& M  R* W. A4 X测试点应加在布线的路上.
+ M* D$ w" h/ Q$ Z

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25#
发表于 2018-1-15 15:21 | 只看该作者
bingshuihuo 发表于 2017-10-17 08:49! c' n* r6 b% {$ i  a' _
时钟测试点 应该怎么加?
( s& _$ r7 H; C" s' @
最好加路径上
! |+ f0 i. Z( Q8 A) w! J# ~
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