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楼主: EDA365QA
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2017年12月20日QA检查报告节选

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该用户从未签到

18#
发表于 2017-12-23 22:08 | 只看该作者
学习了,感谢分享!

该用户从未签到

22#
发表于 2018-1-2 09:50 | 只看该作者
EDA365QA 发表于 2017-12-21 09:01# `( w/ B- O6 Y
4.46V内层孔与铜的间距加大到30MIL。

, y4 Z- H( M! g, @  V% `, C0 U请教一下:一般电压超过多少时会要求孔与铜的间距加大?
0 y8 J( B+ X/ T; v9 p

点评

我做设计的时候压差超过12 V会加大间距  详情 回复 发表于 2018-8-8 14:10

该用户从未签到

24#
发表于 2018-1-5 17:11 | 只看该作者
EDA365QA 发表于 2017-12-21 09:01+ C/ x, y: [2 `2 D9 y) g7 Y
3.DVI的线需做等长

1 a7 E+ _0 [; M: k6 b3 z右边这个net框可以同时这样高亮一组线?以前还真没这么用过。
  • TA的每日心情
    擦汗
    2024-12-17 15:08
  • 签到天数: 23 天

    [LV.4]偶尔看看III

    26#
    发表于 2018-8-8 14:10 | 只看该作者
    xueling2009 发表于 2018-1-2 09:50
    . n* Z2 {0 [9 N% l/ M1 p请教一下:一般电压超过多少时会要求孔与铜的间距加大?
    / |  d# R' P/ `4 r
    我做设计的时候压差超过12 V会加大间距
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