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楼主: sleepyingcat
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最近太无聊了,整理整理关于DDR时序的东西,感兴趣的就过来看看,比较分散,见谅!

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46#
发表于 2010-6-23 13:33 | 只看该作者
顶起!!

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47#
发表于 2010-7-30 11:03 | 只看该作者
DDR是什么东东?

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48#
发表于 2010-12-30 16:34 | 只看该作者

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49#
发表于 2011-1-7 18:08 | 只看该作者
向高手学习。

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50#
发表于 2011-3-6 10:59 | 只看该作者
经验之谈阿

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51#
发表于 2011-3-11 09:35 | 只看该作者
正在用,学习一下!

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52#
发表于 2011-3-11 11:15 | 只看该作者
很好东西,学习了& ~% n, p% n& f- ~; |
' s7 _/ R2 D* D) m3 U; ]+ L5 N

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53#
发表于 2011-5-29 16:57 | 只看该作者
学习学习

该用户从未签到

54#
发表于 2011-6-24 17:06 | 只看该作者
Thanks for sharing!

该用户从未签到

55#
发表于 2011-7-27 10:33 | 只看该作者
数据和地址线需要一样长,还是各自等长就行了

该用户从未签到

56#
发表于 2011-10-6 22:06 | 只看该作者
还在摸索中,感觉LZ说的有点复杂了

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57#
发表于 2011-10-11 17:13 | 只看该作者
好资料呢,但是长度计算公司没有看懂。

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58#
发表于 2011-10-11 17:15 | 只看该作者
fangzi_anny 发表于 2011-7-27 10:33 9 _. ~  X- H2 I' X, v( N
数据和地址线需要一样长,还是各自等长就行了

" \: R  H- C0 z# T数据要与DQS等长,DQS要与CLK等长;地址、控制线要与CLK等长。

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59#
发表于 2011-10-14 16:58 | 只看该作者
  顶一下!!!

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60#
发表于 2011-10-18 11:40 | 只看该作者
要参考芯片公司给的参数吧,各组间的等长线有误差范围的,近期做了一款海思3G的芯片,数据线与控制线,时钟线,差分线有不同的误差,比如50MIL,100MIL,300MIL这样子
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