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开关电源会降低ADC的性能吗?

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发表于 2019-6-17 07:30 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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开关电源会降低ADC的性能吗?
* X, F% H4 w/ Q0 \# ?3 }( Q  Z0 {

# R0 }4 a  L  C/ v  f# Z       工程师一般认为开关电源会降低ADC的性能,因此通常愿意选用低压差(LDO)线性稳压器,而不使用开关稳压器,但这种认识并非完全正确。LDO具有较低的纹波和噪声指标,但最近的研究表明,高效的开关稳压器也可用于一些转换器设计中,前提是设计师对电路拓扑有很好的理解,运用一些实用技巧,同时采取一些必要的防范措施。
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  其次,要查阅转换器的电源抑制(PSR)指标,以了解由于电源噪声引起的转换器性能下降的关键点。大多数高速转换器在第一奈奎斯特区内的PSR典型值为60dB(1mV/V)。
6 q. F+ z0 G8 C2 K
  另外,电源滤波、接地和布线也很重要。在ADC电源引脚处增加0.1 μF电容,可以使噪声降低到比上面的计算结果还要小。在电源输出端增加一个简单的LC滤波器也可行,但级联的滤波器能将开关稳压器噪声抑制得更多。众所周知,滤波器每增加一级就能获得约20dB/10倍频程的噪声抑制效果。紧密叠层的电源和地平面(间距<4mil)可以为PCB设计增加固有的高频去耦效果。最后,良好的物理划分是关键,尽量使敏感的模拟电路远离开关电路。欲在电源和转换器设计方面寻求进一步的帮助,请联系当地的ADI现场应用工程师。
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发表于 2019-6-17 08:45 | 只看该作者
有無任何實作例子
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