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PCIE 布局问题

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1#
发表于 2019-6-25 17:31 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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PCB PCIE走线如果一个差分对的两根线对地距离不一致,对信号影响大吗?请大佬帮忙解惑!
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推荐
发表于 2019-6-26 10:04 | 只看该作者
两层板影响大,四层板有完整的GND平面不大,主要看过孔回流到地平面的速度和距离。

该用户从未签到

2#
发表于 2019-6-25 18:40 | 只看该作者
如果有完整的参考平面,可以考虑去掉包地。7 S3 j$ v0 }. S$ w  X. k  M
你这个包地间距太小,同层阻抗因素必须要考虑了。

点评

每对差分线间距是20mil,这个距离可以吗  详情 回复 发表于 2019-6-26 13:58
大神  详情 回复 发表于 2019-6-25 23:49

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3#
发表于 2019-6-25 23:49 | 只看该作者
huo_xing 发表于 2019-6-25 18:40# }( v7 U- v1 K' r. ?9 g' X0 L
如果有完整的参考平面,可以考虑去掉包地。
8 q  k9 c% v# h! V# }  N你这个包地间距太小,同层阻抗因素必须要考虑了。
7 [/ b& n: A7 p( I
大神
' p: H1 t, s  L2 o
  • TA的每日心情
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    [LV.6]常住居民II

    4#
    发表于 2019-6-26 09:02 | 只看该作者
    17.2软件自带的阻抗仿真工具,跑一下就看出差异了。。

    该用户从未签到

    6#
    发表于 2019-6-26 10:43 | 只看该作者
    要看有沒有符合板廠給的阻抗控制POLAR圖, Y$ E+ \+ `2 T! ~- O/ m: c

    该用户从未签到

    7#
     楼主| 发表于 2019-6-26 13:58 | 只看该作者
    huo_xing 发表于 2019-6-25 18:40
    ; ?$ M/ j$ [. \# l% u如果有完整的参考平面,可以考虑去掉包地。
    3 P+ `# A( R) j7 p$ F# B你这个包地间距太小,同层阻抗因素必须要考虑了。

    ' k0 P+ ^. {0 ~' O+ k每对差分线间距是20mil,这个距离可以吗- b3 }" ^: P. A8 _' o2 K

    点评

    现在的pcb一般100差分阻抗能算到4/5。你周围的包地线间距20mil,对阻抗影响基本可以忽略。 如果不放心可以把参数放到polar里看看。  详情 回复 发表于 2019-6-26 14:12

    该用户从未签到

    8#
    发表于 2019-6-26 14:12 | 只看该作者
    weilaidaren 发表于 2019-6-26 13:58
    ! a' b1 Y2 e4 p& p! O4 F2 W% ?每对差分线间距是20mil,这个距离可以吗

    8 R/ x' [6 v# x- n% ~现在的pcb一般100差分阻抗能算到4/5。你周围的包地线间距20mil,对阻抗影响基本可以忽略。7 v" R, w9 |/ F& }
    如果不放心可以把参数放到polar里看看。
    3 r$ \; j. K: X! \# o7 Z4 e% T; E: g: k* T) h/ L7 V

    该用户从未签到

    9#
    发表于 2019-6-26 20:52 | 只看该作者
    一般来说信号线下面有完整的参考地,而同层的地与信号的距离超过2倍线宽就影响不大了。
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