AD16的原理图导出ALLERO16.6能用的网表

zpf153387889

各位大神AD16的原理图怎么导出ALLERO16.6能用的网表

yihafewu

原理图中元件封装名要与Allegro的封装名一致
导出网络表时选择Telesis
用记事本打开该网表，在所有封装前加英文状态下的感叹号“!”。（在AD填封装名时就添加“!”是否可以？）
让所有Allegro封装生成Device文件（打开对应封装文件，File->Create Device）
Allegro导入网表时，选择other项。

zpf153387889

yihafewu 发表于 2019-7-10 11:58
4 `% t; u' Q/ N' i原理图中元件封装名要与Allegro的封装名一致
5 c. m1 e) f6 A' S" Y' |3 y导出网络表时选择Telesis
" U) \8 o/ b+ ^, |& {! C: ?用记事本打开该网表，在所有封装前 ...

# u* U2 ?- x: K8 A2 m* x大神导入时提示有非法字符，哪些是属于非法字符呢？

yihafewu

cadence有很多字符是不认的，例如空格、小数点、斜杠、星号、井号等。

zpf153387889

谢谢指点！

Tony_zhang

yihafewu 发表于 2019-7-10 14:34
; W- J5 \+ ]& vcadence有很多字符是不认的，例如空格、小数点、斜杠、星号、井号等。

' r2 [; y% J+ v3 }解读很准确！

這侽孓譙悴丶

yihafewu 发表于 2019-7-10 11:58
  b" C% b& y* L7 s$ V原理图中元件封装名要与Allegro的封装名一致
导出网络表时选择Telesis
用记事本打开该网表，在所有封装前 ...

2 L+ G: S" g0 E& a手动编辑的方法。也可以去Skill开发版块下载一个Protel格式网表转换Allegro格式网表的Skill就方便些了，自动转换！
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