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扩频E2无线中继器的设计 & g# A' a4 U' w2 `
0 a. U( \- M/ V3 g5 I0 D, p 摘 要： 数字复接技术和无线扩频技术是数据通信的两大重要技术,本文阐述了利用这两大技术实现扩频E2无线中继器的基本原理和设计方案,并介绍了一种提高数据传输速率的软扩频方法。
; f7 }8 P5 u8 j; A 关键词： 数字复接 无线扩频 软扩频 四相多元双正交键控（QMBOK）
( p1 z& j3 h' b, ? m) S 随着移动通信、个人通信技术的发展,无线通信技术成为发展的主流之一。无线通信产品具有广泛的应用领域和巨大的市场潜力。本世纪五十年代提出的扩频通信技术提高了无线通信的抗干扰性和保密性,已经成为物理层的主要通信手段。现阶段大部分无线扩频产品满足无线局域网IEEE802.11标准,利用ISM频段传输数据速率1Mbps／2Mbps的数据流。但是,为了提高传输效率增强无线通信的竞争力,无线通信必须向高速方向发展。如果按照常规的DSSS扩频方式提高速率必然大大增加带宽,在带宽有限的条件下,如何提高传输效率是许多无线开发商关注的问题。我们研制的扩频E2无线中继设备在这一领域进行了一定的尝试。* n6 C. N+ N) [7 D
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１ 扩频E2无线中继器的总体方案
% d0 ^0 b4 o2 ]# r 扩频E2无线中继器的总体框图如图1所示。
0 i8 e& B' a. A7 d* @1 W 扩频E2无线中继器为全双工方式。作为主端其功能框图见图1(a),来自程控交换机或路由器等有线设备的一次群或二次群数据流均为线路传输码（HDB3码）,若输入信号是二次群（E2）信号,经过码型转换,将HDB3码解码为NRZ码;若输入是一次群信号,则需经过复接和解码两个环节才能输出码型为NRZ码的二次群信号。对该信号进行基带扩频,然后经过中频调制和上变频,馈至天线发送出去。从端是主端的逆过程,其功能框图见图1(b) 。系统中的基带部分、中频和射频部分均在控制器的控制下进行工作。% p; u. U8 _; b
２ 数字复／分接模块设计, C# C) E+ b- e4 r- z* c- a
2.1 数字复／分接原理
3 p) m5 d* b. }5 X: T, B 数字复接的目的在于扩大传输容量提高传输效率。在主端进行复接,在从端进行分接恢复出原来的各支路信号。根据输入信号的不同类型可以选用同步复接方式或异步复接方式,当输入端的各支路信号来自同一钟源,各支路上的数据流之间仅存在相位差而不存在频差则采用同步复接;反之,如果各路数据流来自不同的钟源,存在相差和频差则需采用异步复接方式。本系统考虑到各支路信号可能来自不同的钟源,但是各支路的标称速率一致,故采用异步复接方式中的准同步方式。所谓的准同步数字复接是指：在复接侧各支路先进行码速调整,使其成为同步信号再同步复接;在分接侧先同步分接,再恢复码速。这里所说的码速调整就是指人为地在各个待复接的支路信号码流中插入一些脉冲而使各支路信号的瞬时速率同步,在收端按照复接插入的规则扣除掉插入的脉冲,人们常用正码速调整方法。
F2 C: Q# R" `+ [1 ^" G. z# S, z' @" v. z, I. R
准同步数字复接的帧结构如下：# M: `- C% g8 V; z
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其中F11、F21……F13、F23是帧同步码,码型为：11110000;F33、F43为告警位和备用位;C11～C41,C12～C42,C13～C43为四个支路的插入标志,“1”表示有插入,“0”表示无插入;V1～V4为插入脉冲,如不需插入时则传送信息码。1 N) y: Y+ J) B' {3 [
2.2 复／分接电路设计
- q8 o W1 o X* H 早期的复接设备由分立元器件组成,完成一个二次群数字复／分接需要很庞大的电路支持,随着LSI技术发展,二次群设备大大简化。在国内,武汉邮科院研制出WG03复接芯片和WG02分接芯片,清华大学等单位也先后研制出了类似产品。这里我们选用了北京格林威通信公司的产品GW7600,它将分／复接功能集成到一块芯片上,从而增强了可靠性,减小了体积。GW7600具有如下性能特点：
# q @0 c( G# ~6 O ·既可用于二次群又可用于三次群进行准同步复／分接,符合ITU-T建议G.742和G.751;: x H8 L7 p5 F' { h
·将复／分接集成为一片;; Y. H" ?& P0 M6 f
·内部集成数字式2.048Mbps和8.448MPBS速率的时钟恢复电路;
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·各支路和群路码型都可以单独选择;
! b8 E' k7 N9 K( b: \ ·具有完善的告警功能。/ k" @+ K) J9 R7 g- F
利用GW7600作为核心芯片所构成的复／分接电路原理框图如图２。
+ B( ~* h7 M# v& k$ |: q7 U4 T 其中初始化单元用来设置群路及各支路码型(HDB3/NRZ),复接侧及分接侧双单变换单元将HDB3码的双极性信号变为两路单极性信号,告警信号单元按照G.741标准实时提供告警信号,时钟单元用以提供复／分接电路必需的时钟信号。系统加电后开启初始化单元,进行初始化设置,然后系统自动完成复／分接功能。
; u2 Q: x6 n; U) S ３ 基带扩频模块
' B7 z9 `/ G" ?: M; Y" n 本设备需要对二次群信号进行透传,因此要求基带扩频芯片必须满足两个条件：（1）吞吐量必须能够处理二次群信号;（2）面向E2信号呈连续方式进行传送。目前,国外许多从事专用集成电路开发研制的厂商先后研制出了具有不同特点的基带扩频处理芯片,但是大多数只能处理1Mbps、2Mbp、4Mbps数据流,比如：STEL2000、Z2000、SX043、HFA3824等芯片。HARRIS公司于1998年先后推出了HFA3860系列基带扩频处理芯片,它可以分别工作于1Mbps／2Mbps／5.5Mbps／11Mbps,通过分析较后确定采用HFA3860B作为本系统的基带处理器。 j; U$ s. E, D: O: M7 t) H. a
3.1 HFA3860B简介7 | Y- ^ h. A8 _$ p( }
HFA3860B是HARIS公司1998年11月继符合IEEE 802.11无限局域网标准的DSSS基带处理器芯片HFA3824之后推出的能够处理高速数据流的DSSS基带处理芯片。它不仅对HFA3824具有一定兼容性,而且可以在2.4GHz频段上按照802.11的带宽标准传输高速数据流,该芯片具有如下性能特点：
- C; [7 a4 |3 e. D# q0 b7 L% [ ·扩频增益：≥10dB;
% d0 p5 N( ^; A! S" r3 R* B6 X9 F6 u ·可编程数据速率：１Mbps、２Mbps、5.5Mbps、11Mbps;) ~. [3 A) I: y4 z
·单电源供电：2.7V～3.6V;
R c" q2 G6 R$ g; W$ ] ·扩频调制方式：DPSK、DQPSK、MBOD、CCK;
7 R5 U8 W3 t' v! w; ? w ·支持全双工或半双工操作;1 S! C w/ J# u+ \, _& P# ]1 @
" i; G& g3 }+ u& s o
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' a& x' h# ~9 z& O片内集成有A/D转换器和RSSI电路;
9 ~$ {4 t9 ]) c- ~ ·支持双天线转换。
! C9 w. ?. y% l7 E; E 3。2 QMBOK扩频调制方式
3 [% \0 Q- P' Q" ]$ q9 w HFA3860B可以采用不同的扩频调制方式使其分别处理不同的标称速率,本系统的吞吐量为8.448Mbps,
' `; G8 T3 K+ j& p& [ 可以采用QMBOK扩频调制方式。QMBOK（四相多元双正交键控）是一种软扩频方式,它不同于一般的直扩方式,而是采用编码方法完成频谱的扩展,即用几位信息码元对应一条伪随机码进行调扩。QMBOK的扩频过程如图３所示。
& E: p( f! ~5 N. G: l 输入数据通过扰码器扰码后,按照1.375MHz的时钟将数据按符号送入多路器,多路器将1个符号分解为8bit,d0～d2,d4～d6各为一组。d0～d2,d4～d6分别送入两个修正Walsh函数发生器,然后各输出一个8位修正Walsh函数,d3、d7用对修正Walsh函数的原码取代码,这样,可以在不增加设备复杂度的基础上增加2bit的传送量。数据传换形式如下：# C* _4 u: c, u' [7 S* X! b
& h% P3 z$ ~0 _+ c4 F; l5 d
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' S1 R, c5 \( I6 J. b1 F
其中,符号速率RB=1.375MSPS;数据速率Rb=1.375×8=11MbpsCHIP速率Rc=1.375×8=11Mchips/S。由此可以看出虽然数据速率提高了,但是由于其扩频后的CHIP速率没有变,所以对带宽无影响。MBOK的解扩过程如图4所示。8 ^7 [9 Z" C4 ] s: G* N
解扩过程主要通过三个环节：相关运算、输出极性鉴别和码元判决三部分。待解扩I/Q支路信号分别与8个修正Walsh函数进行相关运算,在Ｔ时刻进行抽样,经过极性鉴别器分离出信号的符号和有效值信息送入码元判决器,在码元判决器中比较｜q1｜～｜q8｜,取其较大值,经过修正Walsh函数表恢复出所对应的３位码字,再结合符号位便可恢复出相应的４位信息,从而达到解扩目的。
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1 p% G1 B m! e+ k% q, N! S修正的Walsh函数表见表1。1 T% V9 I: n' _& W3 Y, l, b5 H
这种调扩方式的扩频处理增益包含两部分：（1）带宽减少所带来的增益 ![]() ;（２）编码增益1.6dB,所以PC=10.6dB。
2 D, V9 l; c3 j4 _3 U# h 3.3 HFA3860B在系统中的应用
, r+ r, i7 w7 `" [7 v1 n HFA3860B的标称速率为11Mbps,而本设备所要处理信号为8.448Mbps,能否将该芯片降速使用是个关键问题。通过对HFA3860B分析发现其各时钟之间有一定的分频关系,它的主时钟MCLK额定频率为44MHz,其它各时钟信号均由其分频得来,TXCLK为发送时钟,RXCLK是接收数据时钟,二者均是MCLK的4分频。如果将主时钟MCLK工作频率降至33.792MHz,则TXCLK和RXCLK的工作频率将降至8.448Mbps,HFA3860B便可工作在8.448Mbps速率下,从而满足吞吐量的要求。再者,HFA3860B主要满足802.11协议要求,进行包方式传送,为了实现面向E2信号的连续方式传送,可以利用FIFO进行缓存完成连续方式与包方式之间的转换,原理图如图5所示。
* D- t' {* }7 m 在图中A、B两点数据呈连续状态,而在其它各处数据按包方式传送,显然每包的数据速率应大于8.448Mbps。这里如何设置FIFO的深度、每包的包长以及控制信号的配合问题是关键问题。另外,为了保证E2数据的频率、相位具有继承性,要求各部分的时钟信号具有继承性,因此,发端HFA3860B的主时钟MCLK是从E2信号源时钟５倍频得来,收端HFA3860B的主时钟由锁相环跟踪接收信号获得,FIFO的时钟由HFA3860B分频、倍频得来,这样逐级继承保证了时钟关系不发生失真。% e/ J# W3 p) n% @4 o
$ {$ I/ x' Z# C! |) n 包方式传送时的帧格式如下。- l" {( B8 c$ A9 y2 a- v; ?
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４ 中频、射频模块
: S7 F- O0 Z/ }. `. q' y s9 ~ f 从系统性能考虑,我们选用Harris公司的芯片组HFA3724、HFA3624、HFA3524、HFA3424、HFA3925实现中频调制／解调和上／下变频功能,如图6所示。在主端,可编程基带处理器3860B输出扩频后的两路正交信号（IOUT,QOUT）,这两路信号在HFA3724中以280MHz为载频完成DQPSK/DBPSK中频调制,已调中频信号再经HFA3624上变频至2。4GHz ISM频段,较后经HFA3925功率放大由双工器馈至天线发送出去。在从端,通过天线选择器选择合适的接收天线接收信号,接收到的2。4GHz扩频信号经收发转换开关馈至低噪声放大器HFA3424,经下变频器HFA3624号送入HFA3860B。' v; p+ d& U8 D" j
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" K! Z9 G( s h7 R 综上所述,无线通信向高速化发展是未来发展的大趋势。在国外,已有厂家着手研制高速无线局域网产品,我们研制的扩频E2无线中继器在这方面作了一定尝试。不难预测,高速无线通信产品必然具有广阔的应用前景。/ g) \' G3 {) A6 V
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发表于 2019-7-24 09:00
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