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RGMII PCB 设计规则

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    发表于 2019-8-12 20:41 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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    RGMII  PCB 设计规则
    % ~4 X$ r! _5 i  Y7 n2 N# p rgmiiPCB设计规则.pdf (67.32 KB, 下载次数: 90) . N" N0 L9 R8 T, d+ K2 V

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    jacky401 + 3 感谢分享!

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    发表于 2019-8-15 09:28 | 只看该作者
    电气特性: RGMII(version 1.3)接口工作电平为 2.5VLVCMOS, RGMII(version 2.0)工作于 1.5VHSTL 接口电平上。7 C" s: j, a: J PCB 设计原则:1 O- j8 i2 V5 t! h" {+ H& h/ f 总原则: 1.各信号线的阻抗控制在 50 欧姆。: m. L& ?8 |1 O9 y 2.组内信号长度差不超过 100mil。 3.尽量不要跨层和电源,地分割线。 发送部分:6 d: C% W- E4 b6 v" Y' w 1.发送数据线 TXD{0:3},TXCTL 等长。4 @* o1 K9 ^2 ^9 z- c 2.发送时钟 TXC 尽量和发送数据线 TXD{0:3},TXCTL 等长。(器件具有内部延时功能)$ k+ ?1 \2 s- O/ D: W 接受部分: 1.接受数据线 RXD{0:3},RXCTL 等长。 2.接受时钟 RXC 尽量和发送数据线 RXD{0:3},RXCTL 等长。(器件具有内部延时功能)8 e0 d6 u  `2 K0 r& b4 _ 器件不带内部延时功能的,在设计中要求从驱动端到接收端的时钟线要在 pcb 上做绕线延时,时间大约 1.5ns-2.0ns

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    发表于 2019-8-13 08:55 | 只看该作者
    《RGMII PCB设计规则》文档内容  W5 `# `1 U6 S8 D  ?: }

    0 f- F/ K) y3 T. b7 r  _7 T一、电气特性:2 U6 Q% H; s# {- [/ T8 [& v" W) z
    RGMII(version 1.3)接口工作电平为 2.5VLVCMOS,
    $ o+ I$ M; u& V3 Q& V1 jRGMII(version 2.0)工作于 1.5VHSTL 接口电平上。) q8 x8 ]6 V* _+ g
    ) f' ?- e, g/ a" }
    二、PCB 设计原则:
    : m5 {% P4 i) c/ T  ]5 |+ K2.1、总原则:
    # _6 K& H% L7 r! }1.各信号线的阻抗控制在 50 欧姆。( Y: U& d4 W5 p# ^
    2.组内信号长度差不超过 100mil。
    : v$ g# ?0 J8 c  Y5 h3.尽量不要跨层和电源, 地分割线。
    . ^7 \4 m6 ]) d# k$ {: W: O3 [, E/ I3 K" k  ~
    2.2、发送部分:
    ; a9 Q* n; e  V& A. p0 {6 P+ ?1.发送数据线 TXD{0:3}, TXCTL 等长。. Q1 y6 Z$ O5 h5 f5 o
    2.发送时钟 TXC 尽量和发送数据线 TXD{0: 3},TXCTL 等长。 (器件具有内部延时功能)
    ! y' A4 `! V  n( U4 m% S$ y# L3 h% K: e9 I! m
    2.3、接收部分:
      D) G* R9 j. V7 {; A1.接受数据线 RXD{0:3}, RXCTL 等长。% J8 P4 b' [9 U9 r% u4 Y/ \
    2.接受时钟 RXC 尽量和发送数据线 RXD{0: 3},RXCTL 等长。 (器件具有内部延时功能)
      F- @  T5 _2 I0 }+ M1 J& B器件不带内部延时功能的, 在设计中要求从驱动端到接收端的时钟线要在 pcb 上做绕线延时, 时间大约 1.5ns-2.0ns* n3 N; w# u& \2 d
    # ]. f  `0 |; _" D+ _) \

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    4#
    发表于 2019-8-13 09:38 | 只看该作者
    电气特性:' \$ Y8 T4 E6 }  O' o7 i
    RGMII(version 1.3)接口工作电平为 2.5VLVCMOS,% t8 v) c. u0 u# @. a5 |: E' Y
    RGMII(version 2.0)工作于 1.5VHSTL 接口电平上。
    ) q( G' G) W! |% |. v2 I/ F7 n/ }PCB 设计原则:6 ^* q: H- O) Z# e
    总原则:
    ' H5 D1 w* F. t! W$ X1.各信号线的阻抗控制在 50 欧姆。
    5 ?0 @' o  r0 I8 s) R! q5 t; R. n8 h2.组内信号长度差不超过 100mil。
    6 }8 [5 e2 b0 @9 k( e5 i: X3.尽量不要跨层和电源,地分割线。6 A5 G+ I! g/ j% i) u8 l. |# O
    发送部分:* H3 M1 P' {' |2 H# g) z+ c0 X2 g/ G
    1.发送数据线 TXD{0:3},TXCTL 等长。+ c6 S% W. J9 K
    2.发送时钟 TXC 尽量和发送数据线 TXD{0:3},TXCTL 等长。(器件具有内部延时功能)
    1 P6 X3 Q  Q3 s5 Y9 u' N1 I接受部分:* H6 z+ q2 ~# e- D" [
    1.接受数据线 RXD{0:3},RXCTL 等长。
    9 q; w, i1 k: u+ U. w2.接受时钟 RXC 尽量和发送数据线 RXD{0:3},RXCTL 等长。(器件具有内部延时功能)
    % @! v0 u) H- ^# E2 W9 Q5 q9 ^器件不带内部延时功能的,在设计中要求从驱动端到接收端的时钟线要在 pcb 上做绕线延时,时间大约 1.5ns-2.0ns

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    6#
    发表于 2019-8-13 10:39 | 只看该作者
    做人要有良心

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    8#
    发表于 2019-8-13 14:42 | 只看该作者
    以太网接口的阻抗不是100欧姆吗?

    点评

    我说的是RGMII,不是RJ45  详情 回复 发表于 2019-8-13 15:01
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    开心
    2020-3-4 15:24
  • 签到天数: 1 天

    [LV.1]初来乍到

    9#
     楼主| 发表于 2019-8-13 15:01 | 只看该作者
    xiaoxiaozhou 发表于 2019-8-13 14:429 y) D6 o( o+ |/ K, y
    以太网接口的阻抗不是100欧姆吗?

    9 Q2 h. {- c8 a8 _1 {! U& V我说的是RGMII,不是RJ45( g# k9 X1 a! Z; A. E3 U

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    10#
    发表于 2019-8-13 16:55 | 只看该作者
    做人要有良心,就几句话,你做成一个pdf,上来赚积分?你直接把这几句话复制粘贴就好了。

    点评

    嗯嗯,初次使用,不好意思。这个积分我得不到。下面已经粘贴出来了你没看见么?  详情 回复 发表于 2019-8-13 17:27
  • TA的每日心情
    开心
    2020-3-4 15:24
  • 签到天数: 1 天

    [LV.1]初来乍到

    11#
     楼主| 发表于 2019-8-13 17:27 | 只看该作者
    宝庆书生 发表于 2019-8-13 16:55' {5 {/ y3 f6 y
    做人要有良心,就几句话,你做成一个pdf,上来赚积分?你直接把这几句话复制粘贴就好了。

    . ~3 k( v* `: A嗯嗯,初次使用,不好意思。这个积分我得不到。下面已经粘贴出来了你没看见么?
    3 R0 @; e  m+ H

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    13#
    发表于 2019-8-15 09:13 | 只看该作者
    不错,值得学习!

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    15#
    发表于 2019-12-12 15:04 | 只看该作者
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