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刚学allegro,问几个比较低能的问题.....以后连载

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1#
发表于 2009-7-29 16:46 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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小弟刚学allegro,用的是Allegro16.0,但有非常重要的任务在身,就是要用Allegro画一个6或8层的手机板。让我学习的时间太短太短了。现在还没入门,可能需要问些比较低能也是比较典型的问题,也希望我的学习经历能给后面学习的哥哥姐姐弟弟妹妹有所帮助.先向即将帮助与支持我的同志表示诚挚的谢意 !
+ |  R* }6 o9 v* j" M1.哪位兄弟姐妹有没有供学习的手机板子,最好有  原理图+PCB,用Allegro画的。
8 q4 v; \9 a9 R( `5 c2.手机板子叠层如何设计最好,以6及8层板为例。并告知每层的厚度及每层该走什么信号线比较好。8 l# s+ e9 `/ r) m& `+ e" S- [7 S
3.今天学习Allegro遇到的几个问题:
; ^  H7 j& S7 P, Z- F   封装Non-standard drill这的几个选项:Laser,Plasma,Punch,Other都表示什么意思,什么情况需要用到?如图:
5 ~4 M3 R% W+ H' h: {0 o9 M" M7 v7 R% T  [4 E( M
2.很多地方看到写了 Allegro/APD, 不知道后面的APD是什么软件,是不是Allegro Package Designer?5 S. ~1 T4 l& S. f1 \
  这个软件从字面上理解应该是做封装的,难道 是画板子的?如果是画板子的,跟Allegro有啥不一样啊?
8 A/ x4 Z8 U2 K: ~# M+ d& Z3.今天在看一个别人画的板子,Show Element一个BGA时,显示这么个东西:1 {- n0 @' P; o9 O# o
    LISTING: 1 element(s)6 D0 R4 V' l4 C: Q" ^4 d
' \% @/ g1 b0 V. P+ @9 I8 p
       < COMPONENT INSTANCE >       3 O5 d1 D3 F. K" J

' m( B- A4 Z8 o3 w% D3 t8 R: L5 K  Reference Designator: U7, p" t" a8 g$ t3 |8 C, s9 ^
  Package Symbol:       PBGA400
& k4 k4 g5 ~: t$ n1 a' K3 @
; k. X% t0 Z0 e* d& s3 q- P  Component Class:      DISCRETE: `# y3 d$ g3 `" s, b* D, e
  Device Type:          KSZ8692P_43_PBGA400_KSZ9692PB+ C5 U+ |, o0 b5 ^5 `9 U$ ?
    Value:              KSZ9692PB
! A5 b8 q0 F: p: }4 k( L! ?* p9 K$ V6 V4 S7 v0 h4 @1 ~
  Placement Status:     PLACED/ i5 c/ {+ M! @1 Y& q
    origin-xy:    (5150.000 4512.500)
+ L9 o% r& x* u( }' c) c    rotation:  0.000  degrees- _' o! V3 y) G3 p7 w) e0 {: u
    not_mirrored
" L3 V9 D: `7 S/ F+ J' N$ g5 E" v4 t) G" O$ L
  Function(s):$ _3 r7 |( _9 m
    Designator: F11# F. G- @$ ~& H# U) b, w+ J: m. a
    Type:       TYPE45 Q( L+ Y. J! n+ G( G% n7 |
    Pin(s):     C10, E10, A7, A6, A8...
/ ?' \+ d% g# X- a
! j, b6 R) g" L( h    Designator: F10
* H3 ~$ |5 S( w, N# \: Q    Type:       TYPE3/ H$ m! H/ K8 j7 c- {& V
    Pin(s):     V16, Y18, T16, U17, V18...4 \, E- ^7 a' j9 }  E2 w
9 Q6 L# w& x8 K+ h
    Designator: F9
" T9 k7 f4 j0 @" c    Type:       TYPE2
( w) r, ?9 A/ n' }* Q* c8 a    Pin(s):     H10, H11, H7, H8, H9...7 s: Q2 W* a! u; k# {, p

1 h; E& N* ^, w    Designator: F8* u9 y$ C  q8 C1 b. y
    Type:       TYPE1
- ]; ?% g2 r* e  D    Pin(s):     H19, H18, H17, P20, M17...
, y- T3 @) J! h+ U0 H( J
1 W, j: ~* Y0 q* s9 r: Q5 e6 [  Properties attached to component instance5 x( o: `0 h6 R2 Q0 l8 L( l2 B
    SIGNAL_MODEL      = KSZ8692P_43_PBGA400_KSZ9692PB_KSZ9692PB
* _: ?# p7 ^  k4 p# I
7 s( h' Q6 }) \" [6 j  Properties attached to component definition
1 j) R8 Q# u; P7 k% ?7 [    VALUE             = KSZ9692PB9 B. ~. l9 }: \& n' D6 o5 K

* Z6 J$ ?/ [) u7 l4 h1 d请问这个Function(S)和SIGNAL_MODEL是指的什么属性?
  ?$ l% S% C6 i% G先就这么多了。希望哪位兄弟能尽快帮我解决一下。

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2#
 楼主| 发表于 2009-7-29 18:57 | 只看该作者
问题继续:# b* x/ q! _) b  \+ a& Q8 I
我看了两个别人画的多层板子,在设置过孔时在Solder Mask _Bottom都设置了阻焊参数。这有啥用啊?1 A5 A* f* m9 p3 m
如附件:1 W" B7 W; ^8 q, U

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3#
发表于 2009-7-30 17:36 | 只看该作者
楼主 你的 Allegro16.0  的软件能给我共享下不! 我到处找下的, 有好多不能用  ,, 我以前都是用 PROTEL 话PCB图的, 现在要用到BGA 的器件,想用这个软件,. _. ^% n* ?' I6 o: c/ q* i% ^
  传个给我好吗!  @ 谢谢啊!@  
6 _. a$ K& I  @+ S4 ~8 {4 S8 x& ~1 P1 u8 W3 J- ^8 U
我邮箱598201378@qq.com,  加我QQ也行, 非常感谢!!!

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4#
 楼主| 发表于 2009-7-30 19:00 | 只看该作者
有5个CD,共2.05G,发不了呀!你到网上找个地方下下吧,应该挺好找的...

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5#
发表于 2009-7-30 19:38 | 只看该作者
2# caiyongsheng 9 w7 m% a, M4 F. ~6 g9 y# `
" [7 R3 |8 I% m+ {# s/ c) I& U

/ }; D5 J0 r- C5 h  h开防焊是不是为了用此via做测试点啊?

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6#
发表于 2009-7-30 19:41 | 只看该作者
建议先拿本书系统地走一下过程吧,然后遇到问题再具体搜索或者问别人一下" R+ T  G2 q0 f$ Z5 b
论坛里有比较好的教程的

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7#
发表于 2009-7-30 20:35 | 只看该作者
真佩服你们公司领导,不知道是他们胆量大,还是在为难你,哎。。。。0 B) L* A* {7 o' I
只能说:你多加油吧,多加班吧!!!

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8#
 楼主| 发表于 2009-7-31 08:41 | 只看该作者
foxconnwj开防焊是不是为了用此via做测试点啊?
. H6 [4 m, J7 h* X
; ^2 q0 M+ h$ h( M( s6 d5楼的,还没看过别人用过孔做测试点呢,过孔露铜在外面,还真没见过...
2 z9 B! y( _2 H" F. w前天听一位前辈说加了mask就是直通的孔,如果不加呢,PCB生产厂商就会在孔中间加些材料堵住过孔,哎,也不知道是不是这样理解啊,望高人再指点一下...

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9#
 楼主| 发表于 2009-7-31 08:49 | 只看该作者
6#8 w) ~0 s: K$ S* {/ P$ y' J
" W, m9 C/ p0 G" G
建议先拿本书系统地走一下过程吧,然后遇到问题再具体搜索或者问别人一下
: H- }2 C7 [! j: B论坛里有比较好的教程的.
1 a* K6 @) z3 d& H8 e: L& W+ }$ J' h# P5 V) Q# o8 ]
这个我当然知道了,我手上有两本教材,就是因为在教材上及网上找不到相关的资料才发上来的。

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10#
发表于 2009-7-31 11:38 | 只看该作者
本帖最后由 biglin 于 2009-7-31 11:39 编辑
. v# B' ]3 m  B! K9 m/ f7 ^; d7 X
8# caiyongsheng
! w: _7 M4 N, |; I; E' \: P& P$ \4 b% E' k  U, P
過孔當測點早已行之多年..5樓兄弟的說法是正確的..

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11#
 楼主| 发表于 2009-8-24 09:36 | 只看该作者
贴子快沉一个月了。% f0 D8 J, K. K' O# Y6 [! d
No_probe_top(禁止探針探入區域):关于这个subclass我看到别人画封装时画了这么个区域,请问这个区域是做什么用的??
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