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楼主: 流誓星空
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【求助】阻抗控制与匹配电阻之间是什么关系?

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    [LV.Master]伴坛终老

    16#
    发表于 2019-11-15 09:31 | 只看该作者
    加匹配电阻是为了消除信号反射
    7 P. @4 G2 M. k8 a( M/ I匹配不匹配要看芯片

    点评

    好的  详情 回复 发表于 2019-11-15 19:02
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    [LV.1]初来乍到

    17#
     楼主| 发表于 2019-11-15 19:02 | 只看该作者
    anguchou 发表于 2019-11-15 09:31
    ; g* p: ?. R) p5 I: o: n; `加匹配电阻是为了消除信号反射' Q) w$ |( t! N/ j6 E
    匹配不匹配要看芯片
    - p2 \4 l! J- L+ Y2 @" f' s
    好的
    " O# l: g1 y+ E# C: ]4 q

    该用户从未签到

    18#
    发表于 2019-11-18 13:38 | 只看该作者
    去百度吧,你不是做电子的吧?

    “来自电巢APP”

    该用户从未签到

    19#
    发表于 2019-11-22 11:18 | 只看该作者
    数字芯片引脚的输出阻抗是变化的 变化的原因主要在于器件的rlc 这个是可以通过外围匹配控制固定的 通路信号阻抗的一直性是保证信号的稳定输出 二者要相互平衡

    “来自电巢APP”

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    20#
    发表于 2019-11-22 11:29 | 只看该作者
    本帖最后由 稀饭饭 于 2019-11-22 11:40 编辑
    ) I9 K- w) A& f6 r5 {
      E! [7 Y% e2 X! i0 i" @* N阻抗控制一般指单端传输线阻抗调整到50ohm,差分100ohm.也有不是100ohm的,像USB的差分90ohm.
    5 x. P: u2 d2 q( x) Z阻抗匹配主要有4种方式,串联匹配,并联匹配,戴维南匹配和ODT。串联匹配就是输出端串联电阻,也叫始端匹配。因为芯片输出阻抗大概20ohm左右,所以串联33ohm,也有输出阻抗不是20ohm的,所以串联电阻可能会是22ohm,10ohm。输出阻抗和串联电阻两者相加等于50ohm,与传输线的50ohm一致。; D. E' Q5 h) Z
    并联匹配就是输入端并联电阻,也叫终端匹配。匹配电阻与传输线阻抗一致。
    $ {9 V6 ]3 S; M# f戴维南匹配,也是在输入端并联2个电阻,分别上下拉。并联的值与与传输线阻抗一致。% C2 h0 S; T9 P8 @; Z
    ODT就是芯片内端接,也是输入端端接。DDR2开始就有ODT的。9 j. W0 t& L. e- X* i4 h8 L# W
    阻抗匹配是为了消除信号反射。  y6 v5 s# F/ r+ r; R

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    谢谢分享!: 5.0
    挺详细的,谢谢!  详情 回复 发表于 2019-11-22 18:44
    谢谢分享!: 5
    加多一句,消除信号反射是为了避免反射波与下一位信号发射波叠加造成的信号失真,比如过冲、振铃等,如果波特率很低,或者传播距离很短,等下一位信号发射时上一位的反射波已经来回多次   发表于 2019-11-22 14:19
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    21#
    发表于 2019-11-22 14:24 | 只看该作者
    加多一句,消除信号反射主要是为了避免反射波与下一位信号发射波叠加造成的信号失真(当然反射问题太严重也会造成实际能量输出分量过小),比如过冲、振铃等,如果波特率很低,或者传播距离很短,等下一位信号发射时上一位的反射波已经来回多次反射而消耗殆尽,就不会干扰到正常信号(能量损失问题应该还是存在),一般也就不需要考虑阻抗匹配问题了。高速、长距离的信号线设计,这个匹配问题就比较重要。

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    俺是初学者,虽然你说的啥都能看明白,但是具体设计的时候就会很犹豫,无法判断频率的快慢以及距离的长短……  详情 回复 发表于 2019-11-22 18:46
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    22#
     楼主| 发表于 2019-11-22 18:43 | 只看该作者
    wngsouchao 发表于 2019-11-14 23:46
    $ }7 m- n1 Z6 }弱弱的问一句器件ide是什么
    . G5 b% I/ m' A0 ^2 i; _' l. s
    器件IDE,我估计应该是芯片引脚的输出阻抗
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    23#
     楼主| 发表于 2019-11-22 18:44 | 只看该作者
    稀饭饭 发表于 2019-11-22 11:29
    8 ^- e/ }2 B, B& ?阻抗控制一般指单端传输线阻抗调整到50ohm,差分100ohm.也有不是100ohm的,像USB的差分90ohm.
    ' K: A$ E9 a. p阻抗匹配主 ...
    " P) S4 @# J) k8 g8 }  N
    挺详细的,谢谢!( k* K4 F$ }: V" e% E) ?4 f
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    24#
     楼主| 发表于 2019-11-22 18:46 | 只看该作者
    topwon 发表于 2019-11-22 14:24
    5 r% U6 |6 |- |- f$ l加多一句,消除信号反射主要是为了避免反射波与下一位信号发射波叠加造成的信号失真(当然反射问题太严重也 ...

    3 z* I. X/ H, r9 M. X2 i6 E- H俺是初学者,虽然你说的啥都能看明白,但是具体设计的时候就会很犹豫,无法判断频率的快慢以及距离的长短……
    4 ?$ a9 n& }7 N& @( X; c5 I# w

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    信号线长度乘以2就是一次反射波走过的距离,除以电波在介质中的传播速度(注意在PCB中会小于光速),就是一次反射需要的时间t。一般3~4次反射后反射能量就基本为0了,所以4t可以作为判断标准,小于信号周期T(当然更  详情 回复 发表于 2019-11-26 09:08

    该用户从未签到

    25#
    发表于 2019-11-22 20:16 | 只看该作者
    建议楼主看下  eric的信号完整性和电源完整性这本书,啃透了就都明白了????

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    谢谢!准备买来看看。  详情 回复 发表于 2019-11-28 15:02
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    26#
    发表于 2019-11-26 09:08 | 只看该作者
    流誓星空 发表于 2019-11-22 18:46
    % ?. z; R- A+ O5 M0 k1 ]2 Z( D俺是初学者,虽然你说的啥都能看明白,但是具体设计的时候就会很犹豫,无法判断频率的快慢以及距离的长短 ...
    ) A! V* s5 N6 F/ ~
    信号线长度乘以2就是一次反射波走过的距离,除以电波在介质中的传播速度(注意在PCB中会小于光速),就是一次反射需要的时间t。一般3~4次反射后反射能量就基本为0了,所以4t可以作为判断标准,小于信号周期T(当然更好是在下一位信号发射的上升沿内)就说明反射波对下一位信号波叠加的影响微乎其微了。
    % `! S7 w4 J+ F9 h

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    大佬这水平可以出书了  详情 回复 发表于 2019-11-28 15:03
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    27#
     楼主| 发表于 2019-11-28 15:02 | 只看该作者
    Kileo 发表于 2019-11-22 20:16
    + {' Y0 n. n" ?2 V" D( Y: Y5 I建议楼主看下  eric的信号完整性和电源完整性这本书,啃透了就都明白了????
    ; l2 a8 y* z* ^. ~
    谢谢!准备买来看看。
      W  F1 P) y# W
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    28#
     楼主| 发表于 2019-11-28 15:03 | 只看该作者
    topwon 发表于 2019-11-26 09:08
    + U4 o1 n3 `: Y* Z+ V3 p1 v  H3 g信号线长度乘以2就是一次反射波走过的距离,除以电波在介质中的传播速度(注意在PCB中会小于光速),就是 ...
    0 q% p7 t4 N4 w# v2 Q# ~
    大佬这水平可以出书了
    # p3 t# B* y8 b. g. D* f

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    29#
    发表于 2019-12-5 12:12 | 只看该作者
    百度一下都有啊

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    30#
    发表于 2019-12-5 13:25 | 只看该作者
    Networks that donot need termination
    One situation inwhich you don’t need termination networks is when the two-way loop time of thenetwork is much greater than a single bit time (~<0.1×two-way loop delay).In such scenarios, the reflections will lose energy each time they reach an endof the network.
    As you can seefrom Figure 1, the amplitude of the reflections will continue to decay eachtime the signal reflects at the end of the cable. Figure 1 shows three roundtrips for the signal and a total of six reflections.
    Figure 1:Amplitude of reflection decay each time a reflection occurs
    Estimating thatthe unterminated end of the bus has a 96kΩ input impedance (a one-eighth unitload), and the source impedance of the driver is 60Ω, the signal reflectionswould decay according to the calculations listed in Table 1.
    Table 1:Example signal-decay calculations
    As Table 1shows, by the time the signal reflects for the sixth time, it has decayed tounder 4% of its original magnitude. After this point it is safe to say that thereflections are no longer capable of causing signal-integrity issues. Since thesample point of a bit typically occurs between 50-75% of the way through thebit, you would want to make sure that these three round-trip delays occurbefore the sample point.

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