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mentor PCB 中cell的 pad 强制赋net

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该用户从未签到

发表于 2019-11-8 17:07 | 显示全部楼层 |阅读模式

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大家好,请问一下mentor PCB 中cell的 pad 强制赋net,这种操作怎样操作。现在的问题如下
  U, Y9 L( ]; ?, f我在使用SOT23封装时,symbol 只有123脚,而cell 是有1234 四个引脚, 那么导入PCB后,就会有4pin 空出来,没有net, 敷铜无法连上去。请问能否把cell 的PAD 赋成敷铜的net,这样两个可以直接连接起来
7 t( e/ ^) ~6 E( b
Capture.PNG
  • TA的每日心情
    慵懒
    2020-3-11 15:45
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    [LV.3]偶尔看看II

    发表于 2019-11-8 21:03 | 显示全部楼层
    本帖最后由 wmz 于 2019-11-8 21:11 编辑 # ~* e/ X3 Z  n9 u- b# H
    7 u# |$ H+ E: l/ ]8 E( c) [
    Mentor EE或VX 是一个很严谨(很死板)的工具,原理图和PCB一致性是保证设计正确性的前提。首先要确认原理图上,2脚和4脚是否相连?! s) f  T$ Q- Q! d
    1.不相连
    3 e& f0 L) P7 D5 u/ i: K) ~那就不要改了% a) w. W+ Z4 C  T/ A- ~
    2.相连
    5 ]! r: B3 I- X8 f1 V7 S3 \①优先修改symbol,使其正确,然后更新网表6 {9 `# N5 |" [" ^( T
    ②如果一定要在PCB中改pin脚网络的话,关闭DRC直连即可,Mentor中是不能在PCB中更改pin脚网络的,但PCB设计是过程,最终的光绘文件才是结果和产品,只要光绘文件对,过程怎样都可以(这种方法不推荐,风险很大)
    0 c6 i9 Q, K( V" g& q/ ~% i; u. W

    点评

    我这边制作的三极管symbol封装只有pin 123,所以pin 4在PCB上肯定连不上了。 像这种器件,一般在制作封装时,怎样处理?  详情 回复 发表于 2019-11-12 08:44
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    2020-3-11 15:45
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    [LV.3]偶尔看看II

    发表于 2019-11-8 21:13 | 显示全部楼层
    对了,直接改PIN脚网络这种操作是AD软件的吧,但跑DRC时会报错

    该用户从未签到

    发表于 2019-11-8 22:06 | 显示全部楼层
    死板也不尽然了,严谨也是这些超级大企业喜欢MENTOR EEVX的原因
  • TA的每日心情
    奋斗
    2019-11-20 15:07
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    [LV.1]初来乍到

    发表于 2019-11-8 23:19 | 显示全部楼层
    强连本身都是有的,只要你确认必须连就行。

    该用户从未签到

     楼主| 发表于 2019-11-12 08:44 | 显示全部楼层
    wmz 发表于 2019-11-8 21:03
    & ]! F3 n" C1 [9 Z4 UMentor EE或VX 是一个很严谨(很死板)的工具,原理图和PCB一致性是保证设计正确性的前提。首先要确认原理图 ...

    1 e2 O' s9 U+ s我这边制作的三极管symbol封装只有pin 123,所以pin 4在PCB上肯定连不上了。 像这种器件,一般在制作封装时,怎样处理?
    & G5 R4 ^  I4 P3 a  O$ |; i

    点评

    wmz
    原理上是4个脚,那就做4个脚的symbol啊  详情 回复 发表于 2019-11-12 17:44
  • TA的每日心情
    慵懒
    2020-3-11 15:45
  • 签到天数: 8 天

    [LV.3]偶尔看看II

    发表于 2019-11-12 17:44 | 显示全部楼层
    jiazifeie0512 发表于 2019-11-12 08:446 a+ ]' \; i; p7 u7 G
    我这边制作的三极管symbol封装只有pin 123,所以pin 4在PCB上肯定连不上了。 像这种器件,一般在制作封装 ...

    ) p4 D5 {2 ~3 _  {. H原理上是4个脚,那就做4个脚的symbol啊' k7 Y# r# \. E, d2 L$ c- o+ J
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