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mentor PCB 中cell的 pad 强制赋net

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1#
发表于 2019-11-8 17:07 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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大家好,请问一下mentor PCB 中cell的 pad 强制赋net,这种操作怎样操作。现在的问题如下
  T) ?( e( o1 ^( f; ]/ q我在使用SOT23封装时,symbol 只有123脚,而cell 是有1234 四个引脚, 那么导入PCB后,就会有4pin 空出来,没有net, 敷铜无法连上去。请问能否把cell 的PAD 赋成敷铜的net,这样两个可以直接连接起来! S2 W: v& o  p  R' g8 f& {" U

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  • TA的每日心情
    慵懒
    2020-3-11 15:45
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    [LV.3]偶尔看看II

    2#
    发表于 2019-11-8 21:03 | 只看该作者
    本帖最后由 wmz 于 2019-11-8 21:11 编辑
    4 l7 r# E9 u" ]
    - M; `& f/ p+ f0 c" w/ zMentor EE或VX 是一个很严谨(很死板)的工具,原理图和PCB一致性是保证设计正确性的前提。首先要确认原理图上,2脚和4脚是否相连?
    ) c+ a, X) A( d; m8 _+ M7 H5 S1.不相连
    8 f* p" L" i& i; G" ?7 S- F那就不要改了) A9 O  f  ]$ j; R0 U
    2.相连# k1 A( Q+ ^2 W; i
    ①优先修改symbol,使其正确,然后更新网表1 {! a' b* g' J
    ②如果一定要在PCB中改pin脚网络的话,关闭DRC直连即可,Mentor中是不能在PCB中更改pin脚网络的,但PCB设计是过程,最终的光绘文件才是结果和产品,只要光绘文件对,过程怎样都可以(这种方法不推荐,风险很大)
    ; I0 m' y( g" `# ?

    点评

    我这边制作的三极管symbol封装只有pin 123,所以pin 4在PCB上肯定连不上了。 像这种器件,一般在制作封装时,怎样处理?  详情 回复 发表于 2019-11-12 08:44
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    [LV.3]偶尔看看II

    3#
    发表于 2019-11-8 21:13 | 只看该作者
    对了,直接改PIN脚网络这种操作是AD软件的吧,但跑DRC时会报错

    该用户从未签到

    4#
    发表于 2019-11-8 22:06 | 只看该作者
    死板也不尽然了,严谨也是这些超级大企业喜欢MENTOR EEVX的原因
  • TA的每日心情
    奋斗
    2019-11-20 15:07
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    [LV.1]初来乍到

    5#
    发表于 2019-11-8 23:19 | 只看该作者
    强连本身都是有的,只要你确认必须连就行。

    该用户从未签到

    7#
     楼主| 发表于 2019-11-12 08:44 | 只看该作者
    wmz 发表于 2019-11-8 21:03
    5 ~! O7 V4 k6 _( K0 ]8 \$ sMentor EE或VX 是一个很严谨(很死板)的工具,原理图和PCB一致性是保证设计正确性的前提。首先要确认原理图 ...
    9 {, b  S% v) ^$ I5 M) q- I% s
    我这边制作的三极管symbol封装只有pin 123,所以pin 4在PCB上肯定连不上了。 像这种器件,一般在制作封装时,怎样处理?+ q" r% l3 W8 D1 l. \& ^

    点评

    wmz
    原理上是4个脚,那就做4个脚的symbol啊  详情 回复 发表于 2019-11-12 17:44
  • TA的每日心情
    慵懒
    2020-3-11 15:45
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    [LV.3]偶尔看看II

    8#
    发表于 2019-11-12 17:44 | 只看该作者
    jiazifeie0512 发表于 2019-11-12 08:44! X) W7 `& k+ A9 L& v; a( c* L
    我这边制作的三极管symbol封装只有pin 123,所以pin 4在PCB上肯定连不上了。 像这种器件,一般在制作封装 ...
    8 i; f9 O; f7 L1 z  n
    原理上是4个脚,那就做4个脚的symbol啊
    " q* L% |' S( O7 K0 A2 R8 o
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