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楼主: cwfang

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大家讨论一下关于ddr2的布线规则

该用户从未签到

106^#

发表于 2010-11-29 13:39 | 只看该作者

，谢谢！

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EDA365微信号及QQ群号！

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107^#

发表于 2010-11-30 13:01 | 只看该作者

谢谢诶分享一下

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108^#

发表于 2010-12-2 11:21 | 只看该作者

下载学习下。

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109^#

发表于 2010-12-2 18:03 | 只看该作者

时钟最好相差20mil data 50mil ！

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110^#

发表于 2010-12-13 22:06 | 只看该作者

学习，学习，，，，

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TA的每日心情

	开心 2024-5-31 15:50

签到天数: 19 天

[LV.4]偶尔看看III

111^#

发表于 2010-12-13 22:30 | 只看该作者

学习一下

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112^#

发表于 2010-12-13 22:45 | 只看该作者

顶起来！

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113^#

发表于 2010-12-21 19:50 | 只看该作者

谢谢分享，另外有关于cadence 约束设置方面的东东吗？

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114^#

发表于 2011-2-7 14:16 | 只看该作者

多谢多谢

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TA的每日心情

	开心 2024-12-19 15:41

签到天数: 36 天

[LV.5]常住居民I

115^#

发表于 2011-2-10 10:05 | 只看该作者

不错，谢谢分享

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116^#

发表于 2011-2-10 14:56 | 只看该作者

十分感谢，努力学习

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117^#

发表于 2011-2-10 14:59 | 只看该作者

DDR3 ，我们都画过了，，哈哈

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118^#

发表于 2011-2-10 17:47 | 只看该作者

看看了

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119^#

发表于 2011-2-13 19:40 | 只看该作者

顶个！

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120^#

发表于 2011-2-14 23:36 | 只看该作者

thanks!

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