TA的每日心情 | 开心 2019-12-10 15:39 |
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本帖最后由 fuxiaohua 于 2019-12-22 09:42 编辑
+ v0 O1 {0 F+ t5 t6 k
- l9 @) C3 E" M: O- T7 d1 t图片形象生动地展示了芯片去耦电容的设计与噪声的关系:
( `, O! U9 }$ H% h! x6 m1. 插件封装电容与SMD电容的差别3 ~. z) e# n9 z# H1 D
2. 电容布局远近形成环路面积的大小导致的差异5 n6 m T6 r2 r
3. 电容脚接地采用走线和平面之间的差异2 u: h k; T# ]0 q* X3 e/ [
- ]/ Q. o+ c8 x, s* f7 x7 E. R+ z5 O5 v& Y0 r1 K
% p" n& h! V& J; k* N$ w N好,不错,不懂原理,只会背结论。; z8 t2 {0 A L1 C; w* v1 {# }1 F& U6 ?
您的这个点评好。那么,我们大家就来聊聊这是什么原理啦? u: ^( y* j7 v) i7 [/ t F7 F5 z: n
1. 电容的本质是什么或者等效模型是什么? 在什么情况下,电容还是电容,什么情况下电容也许变成了电感?
1 a. x% ^3 s: g3 }8 I2. 要想电容是发挥电容有效的作用,设计上需要关注什么?9 G$ u2 C( F( D' l/ U0 ?1 x
补充: Q# k* G+ k# n* f8 M& _$ [
电容的等效模型为电阻串联电感,再串联电容。而电阻来自于电容本身和FANOUT时候的走线或铺设铜皮所带来的;电感也是电容本身和FANOUT时候的走线或铺设铜皮所带来的;当然电容除了自己本身的容值还有与PCB的叠层之间的GND产生的,这个在高速和射频领域需要关注。
8 [+ ?9 y- s( W5 h6 z P F$ R& \, z; c8 p4 s) r% y
那么,A\B\C三点有表现为什么?$ E3 J( i) h% T3 ?+ [
Z=R+JWL+1/JWC2 k9 T) \2 J. v" j1 ?/ t, w4 F* I
当电容为理想电容时,即R/L为零时,电容的隔离直流效果非常好,即A点;' h6 G8 @8 S* q, G" X
当电容的容性与感性协整时,这是阻抗为R,即B点。所以图片的走线不同,导致电感性和电阻性的不同,所以曲线B点也不同。同时,底部的宽度也不同。
A8 g+ y2 d6 o9 X% ~当电容的感性超过性时,电容存现电感状态(即过B会后的,BC段)。 j' Y3 }* l( M. J _; X( b- {8 g
所以,从绿色的图片中,就能够看到不同PCB布局布线的情况下,去滤除噪声的曲线为何会那种趋势的变化。
, y9 a/ f& \2 ]) X( u当您理解完了电容的等效模型之后,自己可以去整理一下电感、磁珠、电阻等其它电磁兼容的元器件。: G$ N/ ]7 F7 A- s
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