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EDA365电子论坛网»电子社区 › EDA工具&PCB设计 › Cadence Allegro论坛 › 【问题】如何找出设置完约束后的网络是那些？
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【问题】如何找出设置完约束后的网络是那些？

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mengzhuhao
  • TA的每日心情
    擦汗
    2020-1-14 15:59

    • 签到天数: 1 天

    [LV.1]初来乍到
    跳转到指定楼层
    1#
    发表于 2007-10-8 14:27 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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    【问题】如何找出设置完约束后的网络是那些？3 n" c: i* _4 C0 w
    像图中的sync为何有两个呢？3 d: I' E* t" c
    文件是系统自带的那个
    * f( G/ {* V3 U  n  D1 Q& x( \! S8 H帮忙解释一下愿意* q: j6 e6 v( `: }2 |
    不知道这个sync规则是怎加出来的

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    SHADOW

    该用户从未签到
    2#
    发表于 2007-10-8 15:17 | 只看该作者
      不是很明白你的意思耶！

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    mengzhuhao
  • TA的每日心情
    擦汗
    2020-1-14 15:59

    • 签到天数: 1 天

    [LV.1]初来乍到
    3#
     楼主| 发表于 2007-10-8 17:01 | 只看该作者
    自己搞明白怎回事情了

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    mengzhuhao
  • TA的每日心情
    擦汗
    2020-1-14 15:59

    • 签到天数: 1 天

    [LV.1]初来乍到
    4#
     楼主| 发表于 2007-10-8 17:17 | 只看该作者
    原帖由 SHADOW 于 2007-10-8 15:17 发表   P- ~4 `% ~  l  w, {# q
      不是很明白你的意思耶！
    搜索的时候选择搜索特性即可找到那个定义的sync网络约束

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    kanglong53

    该用户从未签到
    5#
    发表于 2012-8-12 15:03 | 只看该作者
    图在哪里呢?

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