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1#
发表于 2008-3-31 15:00 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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我刚刚开始学习allegro 有很多不懂的,象大家请教下!
8 F7 l) J& y3 g" z+ {1 w6 p
" _  c" X5 S+ @     1,就是对于已有的独立两个原理图,我怎么做才能把他们变成层次形原理图?!
) N% r3 ]8 s1 J0 s' b+ m     2,在ALLEGRO中我们的原理图器件他的电源和地默认的都是VCC和GND,而且是隐藏的这在使用时很不方便,有没有其他的方法修改下那?6 h5 |' @( i8 `; D5 O! D" W1 T
    3,在画PCB时我们怎么改变过孔?

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kxx27 + 5 鼓励一下

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该用户从未签到

2#
发表于 2008-3-31 15:51 | 只看该作者
1、不是很清楚0 Y3 r4 K1 s% A& ~2 I- s
2、把它显示出来 ;   要不就添加个网络应该可以吧  。   像这样 在弄个电容0 x2 |) Y" ]. e3 D# }, U7 K

, L  r9 L1 J9 W. k' m3、添加多个孔,走线时用那个就选那个5 Q5 L/ _& k& h) J
      
$ J& X1 J8 S* S2 U* x8 G
5 {4 l4 H; u/ b1 n- f或者给NET赋个属性 * U/ l) A+ z9 x+ i) n# n; S
       . U; z$ h' n4 g& |1 S" ]" Y
2 V4 T* l2 E$ D7 o' j, ^1 w
' a8 ~- n6 d9 z  r8 O% k4 T
, t4 ~; R8 f. q( H9 N
如果是另外全部替换孔的 可以这样' B4 T, A- U. h% x9 r& F% e6 q# H6 h
' K  Q5 A( O3 m, l
6 `5 h+ u, J- V! ?' F

( ]5 {1 A" U* U  ?; a3 \/ C 其它的不懂了   收工

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numbdemon + 5 Good
kxx27 + 5 感谢这么认真的回贴!

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3#
发表于 2008-3-31 15:53 | 只看该作者
2,网络重复命名也许会带来错误吧?

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4#
发表于 2008-3-31 16:06 | 只看该作者
原帖由 tnttnp 于 2008-3-31 15:53 发表
' h8 Z4 [! d7 Q) b; H  w2,网络重复命名也许会带来错误吧?
" ^% D& s% |8 n5 D2 u9 ~
! C$ }' h6 l% h
我看有人这么做的,     不过网表中网络名都是VCC ,  应该有个优先级的吧  ,不知道是不是这样???

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5#
发表于 2008-3-31 17:05 | 只看该作者

不管有没有优先级

在同条网路上给两个名字连谈都不值得谈,因为没意义;

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6#
发表于 2008-4-1 08:37 | 只看该作者
原帖由 panhaojie 于 2008-3-31 17:05 发表 $ @  b* |; l2 o0 `. F2 v
在同条网路上给两个名字连谈都不值得谈,因为没意义;

9 m! \5 E+ m3 L# x
) w9 R+ R5 g, q- _哦~      
5 K4 I0 K- @0 q, Y那对于只用到其中一个逻辑门而只画出门电路的器件   怎么连VCC 呢?
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