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1#
发表于 2010-1-30 20:32 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 xxb 于 2010-1-30 20:33 编辑
5 }" s& M( L' w8 ?, e" v' }6 H2 V& d
生成网表时提示下面的错误+ |, g8 [) V1 L5 G
是什么意思啊?8 ]& k3 F+ @. f2 V
谢谢!7 e3 Z8 k' W3 C2 b
[FMT0003] Duplicate pin U7 pin 16. Possibly a complex hierarchy in logical view or duplicate part reference in physical view.
8 f+ q- ?7 \& B6 r5 H3 T  c$ i[FMT0018] Errors processing intermediate file

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2#
发表于 2010-1-31 21:41 | 只看该作者
U7的pin脚冲突了?
0 n; V- W4 y1 F3 D* ~  IDRC有没有做过?

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3#
 楼主| 发表于 2010-2-3 16:02 | 只看该作者
DRC没有做过
$ O  D) c0 H, p) E问题解决了
3 V5 I- d1 [& J谢谢楼上

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4#
发表于 2010-2-3 21:24 | 只看该作者
如果楼主能把怎么解决问题的方法发出了就好了,! ]! J' r3 B+ k" s; z" u9 q
让大家都学习一下。

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5#
 楼主| 发表于 2010-2-3 22:44 | 只看该作者
回复 4# ger11
% n1 _! ~9 ]' ^6 [0 \9 X, S( W
4 i; k7 I: a; d" C
    如1楼所说,生成网表前没有做DRC检查,原理图中元件名重了(两个U7),改过之后没错了。
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