请教一个关于PADS Logic原理图设计的问题。

小樱叶子 · 发表于 2010-2-24 22:08

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在设计原理图的时候，我们都会遇到有某些IC的引脚是不使用的(NC)，此种情况在protel中可以使用一个X放置在该引脚处，使其不进行ERC检查，那么在pads Logic中呢？怎样才能实现同样的功能，屏蔽掉不使用的引脚，以使在unused报告中不出现这些本来就不需要连接的引脚。。请各位指教啦。。。

jimmy · 发表于 2010-2-25 08:37

logic没有此功能。

binmuk · 发表于 2010-2-25 09:03

pads容易出错

小樱叶子 · 发表于 2010-2-25 23:16

没有这个功能啊，就是啊，这样用起来就不那么得心应手了呢。。。

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