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楼主: 用心交流
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capture导allegro的网络表是很严谨的!需要满足那些条件就不会报错呢?

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该用户从未签到

136#
发表于 2013-1-21 13:18 | 只看该作者
把错误的代码复制下百度一下 肯定都有的

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137#
发表于 2013-4-12 10:08 | 只看该作者
学习了                             

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138#
发表于 2013-5-20 15:13 | 只看该作者
很是严谨。。。。。。。。。。。。。。。

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139#
发表于 2013-5-20 21:58 | 只看该作者
学习了!!!!!!!!!!!!

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140#
发表于 2013-5-31 17:10 | 只看该作者
leavic 发表于 2009-3-27 15:51 4 V( i! {4 Y8 ?+ O* G
基本上,主要要修正的问题有两个,一个是同名pin要改成power pin type,第二个是把所有元件的device属性都删 ...
9 v4 X7 \: N$ z# H8 q
同名的PIN改成PASSIVE不行吗?

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141#
发表于 2013-7-9 16:57 | 只看该作者
zjg473 发表于 2013-5-31 17:10
* W0 h5 d: @& C8 X& f同名的PIN改成PASSIVE不行吗?

. d1 {' G1 K8 s6 u/ W2 ]没试过,这个好像不是一般的DRC里面的Pin Compatible检测

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142#
发表于 2013-7-13 10:55 | 只看该作者
学习了

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144#
发表于 2015-3-11 08:29 | 只看该作者
顶顶顶顶顶顶顶顶顶顶顶顶顶

该用户从未签到

145#
发表于 2015-3-11 08:31 | 只看该作者
欢迎到EDA学堂学习Allegro网表导入导出详解

该用户从未签到

146#
发表于 2015-3-15 09:35 | 只看该作者
elmma 发表于 2008-4-6 16:53
: m$ E1 u$ y+ z4 A  r1.元件名称还不能太长,不然出警告.
: o0 J& U# u, f6 t2.管脚的类型也不能冲突.
* n) A% Y' V* t8 ]# e, S我遇到过的情况
9 @% m3 w5 O; k9 g
1方网表可以长名。3方不超过32位半角字符

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147#
发表于 2015-11-17 22:20 | 只看该作者
leavic 发表于 2009-3-27 15:51" X) d0 Z9 b" A+ n
基本上,主要要修正的问题有两个,一个是同名pin要改成power pin type,第二个是把所有元件的device属性都 ...

0 W3 v3 _  m8 vDEvice在哪,不懂
1 S3 v, r  x" n2 L

1234.png (10.56 KB, 下载次数: 2)

Device在哪

Device在哪

该用户从未签到

148#
发表于 2015-11-17 22:25 | 只看该作者
leavic 发表于 2009-5-14 13:35
. q& v" C2 I  L% a28# zyylover
) a* S) `# D0 S( v& n这个,我当初也不记得是在哪个网站看到别人说删除device可以搞定的,刚才查了一下netlist ...

: Q2 J! u1 n6 H到底啥叫Device啊, [& d% e3 B/ g

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149#
发表于 2016-4-21 09:42 | 只看该作者
呵呵,我也是郁闷中,原理图要顺利的导入到PCB里面,还真的不是一件容易的事情。
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