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[Cadence Sigrity] SystemSI中DDR4地址信号搭建S参数,CLK信号Term如何与PCB S参数互连?

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发表于 2020-5-28 10:28 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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各位大神:在System中搭建S参数仿真DDR4的地址信号,CLK信号各串接26欧姆电阻,然后0.01uF电容上拉到1.2V电源,这在SystemSI中如何与PCB S参数节点互连呢?5 ^) g8 w& F" G, d

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  • TA的每日心情
    无聊
    2025-5-22 15:56
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    [LV.8]以坛为家I

    2#
    发表于 2020-5-28 10:54 | 只看该作者
    这里有个文档,可以解决你的问题

    SystemSI_DDR3地址总线仿真详细操作步骤.pdf

    1.7 MB, 下载次数: 73, 下载积分: 威望 -5

    该用户从未签到

    3#
     楼主| 发表于 2020-5-28 11:06 | 只看该作者
    xieda2005 发表于 2020-5-28 10:54
    4 |: e" i8 s6 a  b7 m6 V& ]这里有个文档,可以解决你的问题
    ' O5 w% K3 S6 y  a) X: z! v( F
    好的 谢谢 您有做过类似的案例吗?
    1 H: L: B" ^0 U# y' Y8 k& z
  • TA的每日心情
    开心
    2024-2-21 15:59
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    [LV.8]以坛为家I

    4#
    发表于 2020-5-28 11:07 | 只看该作者
    这个文档里面也存在同样的问题,并没有说的怎么解决楼主的问题
    # M4 Q, P3 F9 n& k7 T, P& a个人认为,无需在PowerSI中单独设置CLK端接的Port,只要将电阻接到电容的网络加入提取范围即可,SystemSI里面也不需要单独加端接模块。

    该用户从未签到

    5#
     楼主| 发表于 2020-5-28 11:12 | 只看该作者
    dzkcool 发表于 2020-5-28 11:070 [& N1 O, U  f" S0 i" J; N
    这个文档里面也存在同样的问题,并没有说的怎么解决楼主的问题
    # c( Q2 y  i6 @% S. @. R( U# C! X个人认为,无需在PowerSI中单独设置CLK端接 ...

    : c% a4 E- I9 x3 I6 b" F9 O大概明白您的意思,您的这种方案是不直接在PowerSI中将串接电阻的值赋予,电容的值赋予,然后加port直接全部提取,但是有个问题,这个Port该加在哪块?是电容非1.2V的焊盘上还是?
    - ^* ~" R( D7 _

    点评

    把电阻电容和中间的走线enable以后这个地方就不需要port了  详情 回复 发表于 2020-6-24 01:43
  • TA的每日心情
    慵懒
    2023-6-20 15:22
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    [LV.1]初来乍到

    6#
    发表于 2020-5-28 11:35 | 只看该作者
    xieda2005 发表于 2020-5-28 10:54
    ; d6 r( Y* K& o& u9 D  |这里有个文档,可以解决你的问题

    # P/ V0 j+ L! h' F( p1 x0 f$ D下载学习下
    . y5 p. |2 F0 {8 p! @$ Y7 w8 P  F6 }
  • TA的每日心情
    难过
    2020-2-10 15:31
  • 签到天数: 1 天

    [LV.1]初来乍到

    9#
    发表于 2020-6-24 01:43 | 只看该作者
    JLP7878 发表于 2020-5-28 11:12+ I5 X/ P8 ]7 F/ e& I& _
    大概明白您的意思,您的这种方案是不直接在PowerSI中将串接电阻的值赋予,电容的值赋予,然后加port直接 ...

    1 M& \" Q# a/ L1 Z+ h% Y把电阻电容和中间的走线enable以后这个地方就不需要port了
    , P' M7 O8 q/ a9 J2 A! J
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