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为什么PCB电源部分的电感和mos管所在的区域不允许走线

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1#
发表于 2010-10-27 15:52 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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x
开关电源的MOS管和电感所在的位置不同层面为什么不能走线
# s7 [- t3 |2 j  A: _+ `$ ~! P即使我的第2层是完整的GND,有联系吗
. X; e; j6 {- P; T

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发表于 2010-10-28 11:00 | 只看该作者
首先这两个器件是干扰源,不推荐走线,没必要冒这个风险。: q( f) d" Q5 a9 g) m
- R  y9 A0 o% @, l& [9 N7 V( r) B* O: ~
即使你参考层是地信号,理论上是屏蔽了,不过还有2点需要考虑
0 k9 A1 k8 H! y8 w  i4 p1:地平面上是否会抖动,根据感性理论,如果上面的电感在震荡,通常会产生相反的电流流向在地平面上* h; A4 Z- {8 F+ J8 f6 ?) w
2:这2个器件都是升温器件,这样你对应的板材介电常数以及铜线都会发生变化,对应点的阻抗也就变化了,低速还可以,高速就值得冒险。

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发表于 2015-1-12 17:21 | 只看该作者
貌似是这个phase地方的电源不是很干净,所以建议这个地方的器件和铜箔下面不允许走线,内部各层都不可以,而且尽量让其他信号线远离这个地方!个人经验谈,理论懂太少,仅供参考。

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发表于 2015-1-21 14:51 | 只看该作者
liqiangln 发表于 2010-10-28 11:00* `, K) ?& Z3 a% s/ `% m
首先这两个器件是干扰源,不推荐走线,没必要冒这个风险。( k' k; s' ]) ?8 _6 Z

5 h" H" |$ k2 D/ ?1 o3 d即使你参考层是地信号,理论上是屏蔽了,不过 ...
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赞一个" K9 R0 s# ]/ k

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3#
发表于 2010-11-5 16:17 | 只看该作者
学习学习。

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4#
发表于 2010-11-10 19:16 | 只看该作者
1.走线会造成phase点铜皮的不完整性,造成low side mosfet漏极尖峰的加剧,劣化EMI* @) S# `) ^/ F$ {
2.开关噪声会耦合到走线上

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5#
发表于 2010-12-21 23:08 | 只看该作者
study  study

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6#
发表于 2010-12-22 15:51 | 只看该作者
学习学习了

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7#
发表于 2010-12-23 13:30 | 只看该作者
恩 恩
  • TA的每日心情

    2025-10-31 15:00
  • 签到天数: 44 天

    [LV.5]常住居民I

    8#
    发表于 2011-1-4 10:17 | 只看该作者
    学习了,前一段时间我们设计的PCB就出了由于这个原因产生视频干扰问题!!!

    该用户从未签到

    9#
    发表于 2011-1-4 10:56 | 只看该作者
    O(∩_∩)O谢谢!! h7 b, v; [0 u+ Y9 A

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    10#
    发表于 2011-1-5 13:41 | 只看该作者

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    11#
    发表于 2011-8-27 11:14 | 只看该作者
    那在电感下面过孔可不可以呀???

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    12#
    发表于 2011-10-1 12:27 | 只看该作者
    学习了

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    13#
    发表于 2011-10-1 13:32 | 只看该作者
    支持 楼上观点

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    14#
    发表于 2011-10-8 16:31 | 只看该作者
    study

    该用户从未签到

    15#
    发表于 2011-10-9 10:41 | 只看该作者
    类似于晶振、晶体的处理方法,因为表层走线会受到器件的产生的电磁干扰
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