pads 原理图PCB常见错误及DRC报告网络问题

Demyar · 发表于 2021-2-1 18:07

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pads 原理图PCB常见错误及DRC报告网络问题
1.原理图常见错误：
（1）ERC 报告管脚没有接入信号：
a. 创建封装时给管脚定义了 I/O 属性；
b.创建元件或放置元件时修改了不一致的 grid 属性，管脚与线没有连上；
c. 创建元件时 pin 方向反向，必须非 pin name 端连线。
（2）元件跑到图纸界外：没有在元件库图表纸中心创建元件。
（3）创建的工程文件网络表只能部分调入 pcb：生成 netlist 时没有选择为global。
（4）当使用自己创建的多部分组成的元件时，千万不要使用 annotate.

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SallyDai2 · 发表于 2021-2-1 18:25

都是很实用的东东，谢谢楼主分享。

qqsszc · 发表于 2021-2-2 09:09

这个必须要顶

gogogo冲冲冲 · 发表于 2021-2-2 09:18

要查看本帖隐藏内容

伴月 · 发表于 2021-2-20 15:07

必须要顶

风风点点 · 发表于 2021-2-22 11:43

学习了。

zjy1905 · 发表于 2021-11-15 09:11

谢谢楼主分享

小强蓝色梦想66 · 发表于 2021-11-15 19:20

必须顶

zhuhj · 发表于 2021-11-16 08:53

mialida0216 · 发表于 2021-11-17 08:55

111111111111

Jonas_G · 发表于 2021-11-18 17:17

赞一个，支持一波。。

rxcc · 发表于 2021-11-19 17:22

看看，感谢分享

发发201 · 发表于 2021-11-19 18:13

看看看看看看看看看看

郑永辉 · 发表于 2021-11-22 17:42

嘻嘻嘻谢谢

1597689180@qq.c · 发表于 2021-11-23 11:38

学习了!学习了!

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