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PADS 原理图PCB常见错误

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发表于 2021-2-5 17:39 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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pads 原理图PCB常见错误
$ K1 Q' E# q/ i0 ]9 q
1.原理图常见错误:
1ERC报告管脚没有接入信号:
    a. 创建封装时给管脚定义了I/O属性;
    b.创建元件或放置元件时修改了不一致的grid属性,管脚与线没有连上;
    c. 创建元件时pin方向反向,必须非pin name端连线。
2)元件跑到图纸界外:没有在元件库图表纸中心创建元件。
3)创建的工程文件网络表只能部分调入pcb:生成netlist时没有选择为global
4)当使用自己创建的多部分组成的元件时,千万不要使用annotate.

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