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原理图完成之后,导出网表的时候, 报错!

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1#
发表于 2011-4-12 11:45 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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Using PSTWRITER 16.3.0 p002Apr-12-2011 at 11:35:05 }# z3 E6 F+ m! S5 ~
#1 Error   [ALG0012] Property "PCB Footprint" missing from instance U4: SCHEMATIC1, PAGE1 (15.81, 5.61).
9 t4 G( u5 L8 N- n+ _5 [) n6 f  c#8 Error   [ALG0031] Pin number missing from Pin "IN" of Package TPS7A4533_0 , U4: SCHEMATIC1, PAGE1 (15.81, 5.61). All pins should be numbered.
: [, ~% l$ p: `5 T# m$ E" j1 F# i
* n6 f( n8 r- e# M% c4 R: N7 n; }% o基本上全是上面两种错误?
3 k7 I. X( v% o" [8 e: E/ M  G" N' ~( P; l
问题 (针对PCB设计):
2 {4 P) ?8 \4 e1 ?; v, f" [2 n- C1)  是不是自动导出网表的时候,在原理图里面必须给每个元件一个 footprint? 而且要确定引脚的number?8 z% q+ S, {+ R3 E! G
2)    如果原理图当中的footprint, 封装库里面并不存在,这个时候, 想换另外一种封装形式的话,是否需要回过去修改原理图?
# a6 h; i5 Y  ]! `- y1 G3)    版图完成之后, 是否必须做一个版图和原理图之间的关联检查? 有点像IC设计的LVS。  . p! G( x% b% ?2 Q

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2#
发表于 2011-4-12 11:55 | 只看该作者
原理图中的symbol或者你调用的symbol的PIN必须要有PIN NUMBER,你调用的元器件要有footprint,否则会出现第一个错误;" H  H1 |' B' t( H/ M  ~9 v
如果想要换封装,把你要用的封装名写到元器件的footprint中,在allegro中把路径指向你调用的封装所在的文件夹。

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3#
发表于 2011-4-12 11:55 | 只看该作者
原理图要进行DRC查找错误的,查找项可以自己选择;

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4#
 楼主| 发表于 2011-4-12 13:16 | 只看该作者
回复 cccccc32 的帖子
) I# V' @3 Q9 T; I! A; D& S% D# h
cccccc32:( T& I* g" Z# d4 Z! v- J6 x) c8 T

" L! @0 j5 N  w% h, ~  b# z! |你说的这个DRC, 是不是指的是pcb的DRC?' w+ k# ?' _$ q

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5#
发表于 2011-4-12 13:20 | 只看该作者
不是PCB的DRC,是orcad里面的,在tools->design rules check,选择要check的项即可。

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6#
 楼主| 发表于 2011-4-12 13:34 | 只看该作者
回复 cccccc32 的帖子  ]% Q; `( X2 E, j: I1 X

+ P. h: I6 \) w( D; A) y, y意思是还是检查原理图的DRC?- C4 a' a$ q: |5 n/ Q- D

( s) C" o, F  k7 Y. K* a我想知道,生成的网表文件到底有什么用?
. j/ o5 Q" w' n# Y! T1 q3 c* i! p& A' j4 p3 S  J

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7#
发表于 2011-4-12 13:39 | 只看该作者
你的原理图中有错误时导出网标失败或者出错,你要查找原因,运行DRC找出原理图中的错误,比如元器件序号重复、封装有错误等;
0 V! q1 ]8 C% }& \网表是原理图和PCB的链接文件,PCB中的所有电气信息、封装信息都是由网表里面的信息产生的;

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8#
发表于 2011-4-12 13:40 | 只看该作者
网表文件包括你原理图中所有电气属性和信息,还有一些比如你在原理图里设置room、设置差分对的信息都在netlist内;
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