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[仿真讨论] 高速pcb电路设计中降低信号衰减方法

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  • TA的每日心情
    慵懒
    2020-8-28 15:16
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    [LV.2]偶尔看看I

    发表于 2021-4-30 14:26 | 显示全部楼层 |阅读模式

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    x
    高速电路设计中的信号衰减是让人头疼的一件事,作为电路设计工程师在布线时应该降低信号衰减。本文主要介绍高速电路设计中降低信号衰减方法,希望对你有所帮助。" U6 d3 q4 _, X+ U! ]
    ) P& J+ E: V' _( `9 j' N
      一、降低电抗路径
    # C/ `. I5 H6 u$ S. Z7 D) A% J; I
      在高速电路设计中,将接地层分为数字部分和模拟部分,但应将这两个部分连接在靠近电源的地方,以便提供一条短的电抗路径。同时,将电路接地通孔栅栏放置在高速电源平面周围会产生良好的抑制效果,因为它会产生两个异相辐射器。7 {4 K. |& S7 R7 ?3 l  F0 k' k

    ! D; ]; y0 j$ H2 P& J% ^; Y( a+ @9 x* Q  二、保证电源完整性  w8 X1 y1 E0 V( b7 u$ ]1 a! ~

    . y8 [. }- v+ m( |3 B9 j! c  高速电路设计时加一个高速地,这样防止模拟电路和数字电路对高速电路部分产生干扰和辐射。如果层数允许,将高速电源平面放置在两个接地平面之间,这将使板上的高速电源平面和接地平面分离。. P* r5 N0 K9 P: @. U& d. ]

    + H3 j. b5 E" ?5 G8 D5 o  三、确保阻抗一致性
    8 M0 M: [7 U/ h! j8 j+ o6 v" z8 e" i# h5 b  g
      在高速电路设计中,由于高速信号会在较短的走线上产生传输线效应,因此较好使高速走线尽可能短。在电路板上使用阻抗控制,以确保走线在整个电路板上具有一致的阻抗。) _( I$ I% J- x. m
    2 Z# d/ A: w  v& |8 I$ A/ {' z
      四、注意过孔
    ; N, K$ }8 l- t/ p+ O- `6 I
    % O5 e; d4 ^8 N4 e  高速电路设计时,以尽量降低使用过孔数量。因为每个通孔都会给走线增加阻抗,而设计通孔以使其具有与走线匹配的特定阻抗非常困难。应该对任何通孔进行反钻,以防止信号共振,并且应格外小心,以确保差分对上的反钻是对称的。如果必须要在高速走线上使用过孔,选择是并行使用两个过孔以防止阻抗变化。这样有两个好处,1、它降低了走线上的附加阻抗;2、并联的两个通孔的总阻抗降低,从而增加了通孔对信号的低谐振频率。& N$ y+ w1 f6 ?8 u6 Q$ f3 T( I
    * j  x2 s6 r( H7 a: I6 O
      五、使用表面贴装元件
    7 S$ s. _* g1 H$ i2 S& x- ~" H2 h$ u2 D: a$ J
      高速信号设计时,使用表面贴装元件。因为使用通孔组件,则元件引脚上的剩余部分会产生另一个信号反射源,从而引起信号衰减。, y* s. H; k  n; F
    9 W, U! t" i& R4 w) x& j

    该用户从未签到

    发表于 2021-4-30 15:42 | 显示全部楼层
    还是无法达到要求就增加驱动器
  • TA的每日心情
    开心
    2021-5-7 15:00
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    [LV.8]以坛为家I

    发表于 2021-5-1 19:07 | 显示全部楼层
    还是无法达到要求就增加驱动器

    该用户从未签到

    发表于 2021-5-5 17:24 | 显示全部楼层
    还是无法达到要求就增加驱动器

    该用户从未签到

    发表于 2021-5-5 21:04 | 显示全部楼层
    说起来很简单,但真正设计起来相当难

    该用户从未签到

    发表于 2021-5-6 09:50 | 显示全部楼层
    高速pcb电路设计中降低信号衰减方法
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