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基于 FPGA 的信号处理系统实现,第 2 版

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    开心
    2020-10-12 15:22
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    [LV.1]初来乍到

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    1#
    发表于 2021-6-1 13:42 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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    描述+ {5 x6 {" l3 }3 K

    3 [/ e7 u% [" p3 ~参与信号处理系统设计、开发和实施的工程师和研究人员的重要工作资源  H* L) [& B. W( {+ g1 c9 D

    ; w9 ?& n% p0 W9 r; }$ Y% a! z在过去十年中,现场可编程门阵列 (FPGA) 的使用迅速扩展到传统数字信号处理 (DSP) 系统之外的广泛应用中。由在 FPGA 研发前沿工作的专家团队撰写,这是第二版基于 FPGA 的信号处理系统实现已经过广泛更新和修订,以反映 FPGA 理论、应用和技术的最新迭代。它从系统级的角度编写,对使用可编程 FPGA 硬件设计、优化和实现 DSP 系统的当代方法和工具进行了专家讨论。并且它提供了丰富的实践见解——连同说明性案例研究和及时的现实世界示例——对于从事无线电、电信、视听和安全应用的 DSP 系统设计和开发工作的工程师来说,这些都是至关重要的。如生物信息学、大数据应用等。在里面你会发现最新的报道:: k4 I7 c1 C* q* [3 v

    . w0 i6 B7 o  r2 A5 F" w适用于大数据应用的 FPGA 解决方案,尤其适用于大型数据集
    . B5 s" W1 n: Q2 _/ F1 R+ D  ~ARM 处理器在 FPGA 中的使用以及 FPGA 向异构计算平台的转移
    / U  Z2 C; ?! u0 l7 x高级综合工具的演变——包括有关 Xilinx 的 HLS Vivado 工具流程和 Altera 的 OpenCL 方法的新部分5 r9 i# k# S- U/ \2 d$ a
    图形处理单元 (GPU) 的发展,正在迅速取代更传统的 DSP 系统
    5 @- o3 j$ p7 ^4 N. r& }基于 FPGA 的信号处理系统实现,第 2 版是参与传统和尖端数据和信号处理系统设计和开发的工程师和研究人员不可或缺的指南。学习信号处理或数字信号处理的高级电气和计算机工程专业的毕业生也会对这本书很感兴趣。: Y! o( j) x! ^

    * |, E! o& V/ H5 ]6 A+ t' s1 z关于作者* k3 e, S: R  \" f
    Roger Woods 是英国北爱尔兰贝尔法斯特女王大学电子和计算机工程集群的正教授和研究主任。
    ) @& ]6 m! ]# ^5 \! Q4 ~9 MJohn McAllister 是英国北爱尔兰贝尔法斯特女王大学的学者。( [5 W7 C6 f4 d  J
    Gaye Lightbody 是英国北爱尔兰阿尔斯特大学计算与数学学院的讲师。4 u; _1 H: y  h6 H0 _' w8 t
    Ying Yi 目前是 SN Systems 的高级软件工程师,SN Systems 是英国索尼互动娱乐公司的全资子公司。
    ) V# e& C7 N2 {3 \; M$ K" U4 a5 u+ j5 {0 @2 q) W3 ]
    权限4 |; I3 ^' X, A5 a/ L3 i
    请求重用本网站内容的许可
    9 Y9 `5 b& Y" V
    ; L. H; q$ i) l% E$ S4 @( k/ h目录/ t1 v; i6 n+ Z# c
    前言十五) H9 N- ?0 ~' s! f- z
    5 g* U3 O& L2 V! o" A- ?2 V
    缩写词列表 xxi
    0 Q& [0 i' [: o' u8 ], f$ [; ]5 ?0 y$ @- z$ L0 C3 N5 R# d2 o: c
    1 现场可编程门阵列简介 1: R- X6 c6 H$ M' D( u
    ; k7 O8 W- v) a( k# [, g* A& T1 {6 t- z
    1.1 简介 1
    : Q. k; F2 o* u- ~: E5 E2 ?8 v6 o6 E1.2 现场可编程门阵列 2$ a; }! q2 K$ |# f' d' d  [1 L
    1.3 可编程性的影响 6, {4 H) S. \- e
    1.4 FPGA 的挑战 8
    * }" D5 S* u- v8 q) d( [( a- H- u& G" B3 H8 U2 [
    参考书目 9
    % v1 }: H2 a0 ~% M% A: m$ m
    . s) {$ ?; G, N3 a* h2 DSP 基础知识 11
      x; `1 ^+ d: F3 |' ?6 J6 r9 Y
    " T9 Q, x4 E% h0 S2.1 简介 11' \4 K/ d& {3 f1 y% B) V# t' |
    2.2 DSP 系统的定义 12% A1 F3 v6 k- j5 y% W
    2.3 DSP 转换 16
    ; U/ Q$ E$ E& ]# L' u, }0 ]2.4 过滤器 20
    5 L+ y9 l, |7 @7 O8 T( O7 n2.5 自适应过滤 29
    % L! d3 i9 q+ Q( r) H$ P2.6 最终意见 38
    " P; F- ?+ L" N& |- W3 q9 b6 Z
    . e2 j' I2 @+ K: `) Q参考书目 38
    / N% t5 y$ X9 d8 o& f4 ~
    3 w* f. [2 @8 ?0 A$ f3 算术基础 41
    ) T) J/ `& J1 b2 f! G1 I: }3 u) Q: K* c* k& p. \; ^- q+ d/ `! A
    3.1 简介 41
    . u  O4 l9 x* S; `2 x3.2 数字表示 42% v4 |& h; f. T! h) M0 R! ]
    3.3 算术运算 47
    , g! a5 T) f) e1 A0 p0 r2 L3.4 替代数字表示法 55
    % w  }- n# z$ N& {7 O$ }3.5 59 项3 [. h, n/ b% g: K
    3.6 平方根 60
    9 K, R$ t5 B4 Y. I0 S! e: Z* V0 T3.7 定点与浮点 64
    ' V7 p  o! U6 ?$ R, K7 W; O! j4 `3.8 结论 66# ~  k1 {/ A4 Q; a" ~* i: v; [$ C$ J; P

    : S. l8 C. g3 z5 L* W4 r- {参考书目 67
    , Q. z6 {/ Z( K# ]/ w" a. f% i8 G# M6 }) i5 a6 E' o
    4 技术评论 70
    0 q+ J1 H8 {( F; i/ j
    , z9 S) ~' m' N( o9 F5 t4.1 简介 70
    % }5 D1 W$ Q# J- X4.2 技术扩展的影响 711 ?: b% n4 h, u3 g% ]
    4.3 架构和可编程性 72: K5 y1 D1 v! o' R9 d  P
    4.4 DSP 功能特性 74
    ; [1 z6 a0 [% [# Y6 C- h: i+ v) T4.5 微处理器 76
    + U* k" x. Y$ ^1 N* C4.6 DSP 处理器 82" Y- w& Y5 }& w) V0 @
    4.7 图形处理单元 86" b' E* ?, ~; N" c, t; `# n% a
    4.8 片上系统解决方案 88
    + ]0 _! {; V4 i2 [9 K6 ^4.9 异构计算平台 91% |1 U: d1 B( y
    4.10 结论 928 c6 \" D+ X4 k, @. z3 l* Y0 A" a. B

    ! o4 H: K% V2 q2 v参考书目 92
    # |% _' D; @; W1 Z6 ~2 ]# E& q: l, c. j: s
    5 当前的 FPGA 技术 94
    ( i* B( w. b& K9 O6 d& J; j0 e% k/ P7 N& ^0 f' X! y
    5.1 介绍 94% b; [% H* c7 @4 Q9 |3 ?
    5.2 面向 FPGA 95" X. f5 g+ q) l5 u) e' q* z
    5.3 Altera Stratix® V 和 10 FPGA 系列 98
    & p+ r' j( ~8 K; f+ j1 P. H5.4 Xilinx UltrascaleTM/Virtex-7 FPGA 系列 103
    " I, |  w0 `5 c4 f& q: k. b7 X  L5.5 赛灵思 Zynq FPGA 系列 107
    9 A; i' x: k/ ]# G7 f5.6 莱迪思 iCE40isp FPGA 系列 108+ q7 E8 T2 I0 s* j
    5.7 MicroSemi RTG4 FPGA 系列 111
    : ~7 n9 `" Q- w5.8 基于 FPGA 的 DSP 系统的设计策略 112# _' \% T8 [' X/ q  f
    5.9 结论 114
    . N4 d) i0 A; x' u# C
    " x1 F6 ~5 B* g! D, }  \) B参考书目 114
    2 z/ O3 y8 G6 P. L2 L4 P4 d1 H- g0 h1 K
    6 详细的 FPGA 实现技术 116
    9 N0 Q- w; @9 \6 H+ ^% Z" g# y) c* j3 O
    6.1 引言 116" D% k( f. X6 T) _6 y* @
    6.2 FPGA 功能 117; f( M) k4 {. X# Q& h7 `- M' O
    6.3 映射到基于 LUT 的 FPGA 技术 1239 X) f# L: v8 U2 ]* j
    6.4 固定系数 DSP 1256 Q* _7 p: a: Q( U
    6.5 分布式算术130
    # @( M8 x/ N* l6.6 缩减系数乘法器 133
    " U2 O+ F9 `7 K# [3 A* v) G6.7 结论 137
    7 v/ `: S0 |9 S$ Y. ]* S
    0 q" r5 Y% l" ?参考书目 138
    0 c# J: |% V! H7 E# w
      S6 X- x$ s: \/ V7 种用于 FPGA 的综合工具 1405 w, n0 X0 g$ ^+ B) L9 N

    * Y/ F* }0 B: u* r6 C! V% ]7.1 引言 140+ B( o0 [0 H5 V" U. ^5 g
    7.2 高级综合1413 }9 z- |( [) t3 J+ }4 @7 S; ~( r
    7.3 赛灵思 Vivado 143
    9 f; L1 w: O  P) ]0 r8 ?9 l7.4 控制逻辑提取阶段示例 1440 ~+ F% m  ~/ @$ I9 d
    7.5 用于 OpenCL 145 的 Altera SDK. O/ R! Q8 I. R, N! s+ T" H$ A( Y
    7.6 其他 HLS 工具 147
    * Z5 f1 ?; |7 ^7 p3 j% Q4 m7.7 结论 150
    7 O' j: ^$ M' H, G5 _4 o$ Q2 X3 C, \
    1 N, I+ J- s3 ?% ~参考书目 150
    + H2 R9 ~8 P* c, i
    : I' K( ^+ }; h; P' A7 C6 x7 U2 L8 基于 FPGA 的 DSP 系统的架构推导 152
    ' S( f7 {9 J$ U+ T, ^! _1 R  Y; e0 u$ x2 Y6 ]
    8.1 引言 152: L7 U* V1 U3 D0 J8 D8 w. u
    8.2 DSP算法特点153, B) y( Q, C: A* s! w
    8.3 DSP 算法表示 157
    4 v4 C" K) H  M2 O8 r8.4 流水线 DSP 系统 160
    / `! j, k4 l/ O3 n4 ^6 l) d8.5 并联运行 170
    & H+ t# I: V' m9 O0 R8.6 结论 178* o- N  {% N/ W) S

    & w" t! v4 D& s/ x7 N参考书目 179
    # y4 v: m8 i$ q6 o
    % k' X* {  B0 w0 J. o  H9 FPGA 180 的复杂 DSP 内核设计
    ( `, _( K. r& E/ X
    * B- U; P8 t5 U$ ~* i( ^, |9.1 介绍 180
    + v$ w' u  m  ?/ ~0 f& K' \9.2 再利用设计的动机 181
    3 b" K6 S% h4 b& r3 X' U: E9.3 知识产权核心 182
      D5 i; O  }7 k' p9.4 IP 核的演进 184* Y4 u9 ^) O- {! h
    9.5 可参数化(软)IP 核 187) m/ ~% _2 ~2 L8 v) Z
    9.6 IP核集成195
    " a* a+ @6 i" Q) t0 o& ?9.7 当前基于 FPGA 的 IP 核 197
    % T2 `- Y/ q& w! X9.8 水印IP 1983 B2 }! _$ J% w$ S* g# f
    9.9 总结 198
    ) {7 E9 g: A" o2 A: S9 i. J0 c
    4 c( J9 i7 u0 n' n参考书目 199! I: Y. D) D6 T1 P5 \

    & a1 ?  P" J3 e$ U6 h( v10 基于高级模型的 FPGA 加速器设计 200
    $ r& x% |+ \0 u5 g8 O5 q6 ^
    # l% j: q  C4 Q" {* E7 I10.1 引言 200
    " I9 T% q: Q& e/ U' k5 }10.2 DSP 系统的数据流建模 201* W0 S( b3 u9 J. G0 W( ]
    10.3 DFG 204 定制电路加速器的架构综合9 o3 {2 u. K5 ~
    10.4 基于模型的多通道数据流加速器开发 205# o5 X3 a" m; X# p2 ]$ `
    10.5 基于模型的内存密集型加速器开发 219+ V& U4 p5 S6 y( D, S. q* p+ ?
    10.6 总结 223; x* w. o9 M- ^$ I2 T1 q. ^
    5 R$ N. O+ T; u, ~
    参考文献 223
    : V3 P, G! _& G  @
    $ {5 e! G! I6 X6 Q2 D11 自适应波束成形器示例 225, ?6 {& V2 K: x' B; n

    5 S6 _% L  X) ^, g& Z$ H, g3 m11.1 自适应波束成形简介2263 J8 u* h- z4 ~
    11.2 通用设计过程 226
    $ D$ T, }: n5 b8 h# I7 T11.3 架构算法231# @! M) C6 f/ D: T5 U
    11.4 高效的架构设计 235
    0 B* X1 ~: D5 P. `, v. Y11.5 通用二维码架构 240
    ' N4 q  B! Q4 r- @7 o' ?  ?; l11.6 重定时通用架构 246
      @* u& H8 v: ?9 I7 f( M/ u11.7 可参数化的 QR 架构 253% ]( k9 t" y0 x
    11.8 通用控制 266
    / @4 _* z" w* a% `6 e9 o0 n11.9 波束成形器设计实例 2699 B) b5 B7 z- A) D  e: {
    11.10 总结 271; b3 u8 O: d8 n5 J& M+ C4 K

    + N  g. c2 n" Y3 R8 z1 s参考文献 271
    * `9 `; b6 k0 ?+ b( X, B2 D& ]: X8 e
    12 大数据应用的 FPGA 解决方案 2739 p; F1 L) Y3 f: n" g4 m* g

    / D" q6 T- F/ @7 f% T0 e12.1 引言 273
    $ p" t* S: I% p- O9 r" t5 B6 Y12.2 大数据 274
    . d' N/ e  a+ y. }: a, m/ d1 l12.3 大数据分析 275( i; t$ R  l( O' j. {$ Q, r: R
    12.4 加速度 280, h8 @: y4 ?4 ~4 c9 u
    12.5 k-Means 聚类 FPGA 实现 283
    / s) D; B8 A) q0 J2 Y7 G1 M$ y12.6 基于 FPGA 的软处理器 2867 G+ s6 s+ R4 d' _* r
    12.7 系统硬件 290) x( R6 ], u( F  h  w6 C: Y
    12.8 结论 293+ w9 V$ V1 n0 D! _2 X
    & E7 T5 x) |1 R0 a5 W& L# c
    参考书目 293
    , S' f8 T9 F% h7 t' C  P
    . e3 ^( R1 M9 ?. y  E$ [* O, ~( [' v13 低功耗 FPGA 实现 296
    ' r+ h& \$ \3 ~& y- O4 ^' g
    : S! x) p0 O1 z+ z: S3 `5 c13.1 引言 2969 Z8 O3 K" |% B7 C( {3 [4 [9 m
    13.2 功耗来源 297
    3 Z) Q$ [& _: {# T& y2 B13.3 FPGA 功耗 300
    ! H  l8 ~4 j  d0 n4 H' p2 ?8 B) E13.4 功耗降低技巧302
    - M! x4 J  y3 a% o2 i0 K0 \13.5 FPGA 中的动态电压调节 303
    . ?, O" n+ [, K7 k13.6 降低开关电容 3052 z2 X9 o9 C  J+ D0 J( P! f( a& H
    13.7 最终评论 316+ {: h; `0 M" |! l5 G. j

    # v! R! K7 E8 }( ^- o2 k! S8 x参考书目 3175 N5 g4 e8 y1 r9 G  i0 c' ?

    5 K4 U0 b$ J0 t+ b& N4 a14 结论 319. i. O! q  @  o: F
    & ~# j' V- m: G& O# _
    14.1 介绍 319& x+ f: w/ _# B% |: d. B* J
    14.2 FPGA 设计方法的演进 320
    ( r# \& v% L' I: [0 o2 A5 I/ h! ~14.3 大数据和向计算 320 的转变2 W+ T/ V) p2 i3 Q7 N2 Z
    14.4 FPGA 的编程流程 321
    4 i0 o1 m7 \0 `0 E0 H( Z6 `14.5 支持浮点运算 322
    - a  ]  s5 c; Y% p$ _' p14.6 内存架构 322- c( Y$ [1 j. D- c2 c0 |& n

    8 X' t  Y/ ?) Q: Z参考书目 3236 k! ^6 \. _4 Z- [8 j, y' t

    ' r9 T! j) D  ^' [, P: n' \3 _索引 325
    4 ~5 v" Z+ I$ i) y
    ) W3 R3 F0 ]& d) w; ^

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