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发表于 2021-6-11 15:26 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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请教一下硬件大神,  对于存储芯片堆叠的设计, 每个芯片默认有4个CE。
; j& p! l7 C' Y$ Q* k4 o: `, G
* L9 j! y6 F) x; ]& M- Y, h# D  b# v+ E% V( h0 o
如果只需要堆叠2个芯片,理论上只需要设计2个CE就可以正常工作。1 U$ d  a) {0 F/ b

7 J% R5 p4 C- i6 w3 V5 B有两种电路板:第一种电路板上设计4个CE,2个CE工作,另外2个CE是空脚状态。7 X, i/ i$ ?$ @3 n0 u
第二种电路板上设计2个CE。9 A" b0 u! N+ X' [; N4 _

  E: |$ L1 p- j- {第一种电路板会比第二种电路板更加耗电么?7 I6 R/ A& k- ?$ `5 `8 E. C

. X. J/ G; i7 p8 u1 Z7 j; i; W
6 S! A  Q3 e% X4 g: I
3 }+ U/ t8 _1 e5 G. ^

该用户从未签到

2#
发表于 2021-6-11 18:00 | 只看该作者
帮你顶一下,看看别人怎么说" q6 z4 ]! G. `9 f) f& i3 I9 g

该用户从未签到

3#
发表于 2021-6-14 10:59 | 只看该作者
就绝对而言,是的,还会有更多。7 m( S- f# ^4 Y4 D9 G5 q# U- X
将两个场效应晶体管的操作添加到 CE 个电流增量几 nA

点评

请教一下 这句话怎么理解? 将两个场效应晶体管的操作添加到 CE 个电流增量几 nA [/backcolor]  详情 回复 发表于 2021-6-21 08:13

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4#
 楼主| 发表于 2021-6-21 08:13 | 只看该作者
lock_lilu 发表于 2021-6-14 10:59) `: {2 I+ J- K( h; U0 z5 [+ r/ R9 P
就绝对而言,是的,还会有更多。! _4 ~' F- J: F; r; C
将两个场效应晶体管的操作添加到 CE 个电流增量几 nA
& m: V# a# J- Q
请教一下 这句话怎么理解?
4 X% v/ D" z+ o# u/ x6 d/ X: r  K6 d' h
将两个场效应晶体管的操作添加到 CE 个电流增量几 nA : n, X# A9 C: n

点评

关键参数答案 IDSS - Zero Gate Voltage Drain Current IGSS - Gate-Body leakage current 以及文件的链接 Field Effect Transistors in Theory and Practice Application Note AN211A.pdf nxp.com/docs/en/app  详情 回复 发表于 2021-6-22 09:37

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5#
发表于 2021-6-22 09:37 | 只看该作者
tencome 发表于 2021-6-21 08:13
  B3 ?; q3 y* T6 c- p7 z请教一下 这句话怎么理解?- Q2 U# V) U' R* o& D
+ j* P5 o7 |( v2 U8 n
将两个场效应晶体管的操作添加到 CE 个电流增量几 nA

0 j# ~0 k. k/ z2 r& w  W- v关键参数答案+ ?3 K; U1 F% s6 c. e; T& f  }8 J
IDSS - Zero Gate Voltage Drain Current
; i, D7 g8 u7 sIGSS - Gate-Body leakage current) `6 o; o6 Z, R" l0 q5 h$ a
以及文件的链接
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[size=0.87]Field Effect Transistors in Theory and Practice Application Note
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[size=0.87]Field Effect Transistors in Theory and Practice Application Note
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