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想問一個PCB Layout 0.8Pitch LVDS 出線問題

TA的每日心情

	开心 2023-10-9 15:14

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发表于 2021-6-18 09:45 | 只看该作者回帖奖励

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想請問各位們，如果PCB板廠幫你計算出來的差動線寬線距是 3.15mil, 5mil時，但在BGA 0.8pitch情況下我卻無法同時在兩個via間走一組差動對，那想請問這時我該如何做比較好?(目前在軟體上設定線寬3mil,線距3mil是可以出線的，但有時板廠會說這板材無法達到100R 頂多90R)，想請教各位的解法為何?

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发表于 2021-6-18 11:45 | 只看该作者

bga部分按3对3出线，出了bga部分再走正常线宽线距

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請問有圖示或資料讓我當作參考嗎因為我還是有點不太懂意思详情回复发表于 2021-6-28 13:39

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发表于 2021-6-18 13:43 | 只看该作者

BGA下面可以先走线再阻抗，在PIN之前加TAB来匹配阻抗，BGA下面阻抗不达标也可以接受

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所以其實並不是我想像那麼嚴謹了详情回复发表于 2021-6-28 13:40

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楼主| 发表于 2021-6-28 13:39 | 只看该作者

小毛同学发表于 2021-6-18 11:45/ R" V5 D1 W! y
bga部分按3对3出线，出了bga部分再走正常线宽线距

請問有圖示或資料讓我當作參考嗎因為我還是有點不太懂意思

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	开心 2023-10-9 15:14

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楼主| 发表于 2021-6-28 13:40 | 只看该作者

asdf193 发表于 2021-6-18 13:43* N3 |$ O7 `/ r5 {1 g
BGA下面可以先走线再阻抗，在PIN之前加TAB来匹配阻抗，BGA下面阻抗不达标也可以接受

所以其實並不是我想像那麼嚴謹了

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