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[毕业设计] Pareto支配的MPRM电路面积与可靠性优化

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发表于 2021-6-24 09:10 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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摘 要: 针对 MPRMMixedPolarity ReedMuller) 电路的面积与可靠性折中优化问题, 在逻辑级建立面积估算模
& D! W1 @3 N. n+ R$ |; e0 G( G4 C0 B型以及电路 SERSoft Error Rate) 解析评价模型, 并采用 Pareto 支配概念对 MPRM 电路进行面积与可靠性多目标优化
- i$ Y* ?# B& h+ `/ \' O4 B7 m通过对 MPRM 电路的 XOR 部分进行树形异或门分解, 并考虑多个输出之间异或门的共享, 建立面积估算模型采用: ?3 D" @7 n9 s* A
信号概率和故障传播方法, 并考虑电路中的逻辑屏蔽因素以及信号相关性, 建立电路 SER 解析评价模型根据所提出  ^# d7 }: z: A7 d4 k# ~
的面积和 SER 评价模型, 采用极性向量的格雷码序穷举搜索 MPRM 的极性空间得到 MPRM 电路面积与可靠性的 Pa7 w' v6 K/ K' X1 S, l
reto 最优解集, 并使用效率因子技术指标选取最终解. MCNC 基准电路的实验结果表明, 与面积最小 MPRM 电路相比,
7 G" k; C1 l" f( |* V' e: W所选取的 MPRM 电路可以在较小面积开销的前提下获得较高电路可靠性: Z8 Q/ |  @* B
关键词: MPRM 电路; 可靠性优化; 面积优化; SER 解析评价模型; Pareto 支配; 多目标优化
6 T. f+ `1 Y& `
4 h" ?) _% l1 h( v 基于Pareto支配的MPRM电路面积与可靠性优化.pdf (597.02 KB, 下载次数: 0)
8 v! F, u& ?0 z* C

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发表于 2021-6-24 10:33 | 只看该作者
Pareto支配的MPRM电路面积与可靠性优化 ,收藏了。
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