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[仿真讨论] 关于50欧姆终端并联匹配的问题

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1#
发表于 2011-6-9 12:26 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 hgzty 于 2011-6-9 12:48 编辑
2 W; f8 J8 m- w! C& z
$ o7 m! E# A0 g+ J4 h      对面设备是5V TTL的输入标准 VIH:2V,有一个50欧姆的并联匹配电阻接地。信号速率在100M以下。3 T3 y& r( v0 D' B
5 p0 p$ L2 d( ?% q* i6 V% j) s
       我的设备是这样的情况,cpld输出的是3.3V TTL/CMOS 电平。那就是说如果要能够正常驱动的话,起码要有40mA以上的驱动电流。也就是说我必须设计一个满足5V TTL输出电平又同时满足驱动能力的接口.
9 z# ~; e. [8 f. s
& T* q$ W1 j7 F) H2 e      现在的想法是,CPLD输出的3.3V电平信号首先通过电平转换为5V TTL,再通过line driver芯片进行驱动。, u: G+ I4 A& n: z- S! R

$ @" q3 U4 M. u( B1 |+ ^$ J; ]! y* [     还有一种设计就是CPLD输出的CMOS 3.3V电平信号直接驱动 5V TTL的line driver芯片。
% N! O% n* f) E$ |. N% u
; U8 k* ~: H) O. {: m想问一下的就是," ^0 P) O$ w7 ?; ~
1.40mA的驱动电流计算是否正确?, y* f5 ?, g/ p; Z7 x6 e6 W
2.如果考虑到输出阻抗的话,那在输入端不是还会有一个分压?5 ~% R' l6 D  }: e' J
3.有没有直接支持3.3V电平信号转5V 信号,且5V输出这里又有比较大的驱动电流的芯片?
6 C3 M$ U1 H4 U8 m/ p1 ?
( Z8 }4 c0 M% h* W
  • TA的每日心情

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    2#
    发表于 2011-6-9 20:27 | 只看该作者
    一般情况下不会采用终端并联端接,用源端串联端接。

    该用户从未签到

    3#
     楼主| 发表于 2011-6-10 14:16 | 只看该作者
    回复 willyeing 的帖子
    8 d9 ]# ?7 ]% @. y
    0 E7 \( `) ^* [! X. a明白,但是对面的设备信息如下:, ?9 \% R: G5 W: [: i; c# r8 a

    3 s6 W- E- [2 G- }" v  U. g
    2 M6 A2 N% g: t+ {6 O+ _input impedance : 50 ohm  g. J$ w% ~! b6 z  \
    input level :HCT# v* Y( ~) ^- Y5 }1 W7 H* L7 J, L2 G

    " q4 F  ?7 J. _所以没办法。
    # k9 {' N: z  E2 J9 w- y
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    4#
    发表于 2011-6-10 19:59 | 只看该作者
    查查ti网站上有很多这种电平驱动芯片,网站上挂了很多应用笔记,应该有满足你要求的芯片的

    该用户从未签到

    5#
     楼主| 发表于 2011-6-16 16:53 | 只看该作者
    谢谢楼上的回答,在ti上找了一圈,根据驱动电流选了ABT的器件。应该能够满足要求,想知道的是这种SN74ABT16245A的器件输出阻抗一般是多少的。
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