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[仿真讨论] 关于50欧姆终端并联匹配的问题

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1#
发表于 2011-6-9 12:26 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 hgzty 于 2011-6-9 12:48 编辑 3 p) G# \) D3 K- z$ e7 |8 E' U

$ ?- e8 A$ d. b& q  h3 y      对面设备是5V TTL的输入标准 VIH:2V,有一个50欧姆的并联匹配电阻接地。信号速率在100M以下。5 {5 R9 k( F4 j( R& w

6 ~  U1 t9 B/ |3 ]: z: _! M       我的设备是这样的情况,cpld输出的是3.3V TTL/CMOS 电平。那就是说如果要能够正常驱动的话,起码要有40mA以上的驱动电流。也就是说我必须设计一个满足5V TTL输出电平又同时满足驱动能力的接口.
; _4 c3 a: z# `. ~4 g% q
& z$ R0 R6 s% M  J9 ?/ q- w) y      现在的想法是,CPLD输出的3.3V电平信号首先通过电平转换为5V TTL,再通过line driver芯片进行驱动。
1 h: j9 p$ W+ _5 s1 c0 ^. R( I% t0 o" ?
     还有一种设计就是CPLD输出的CMOS 3.3V电平信号直接驱动 5V TTL的line driver芯片。
* y- V7 V( \1 c: ^! V: y! J% }7 P1 @, Z) t" t) s: z) [* j
想问一下的就是,. q% b3 \9 V8 g
1.40mA的驱动电流计算是否正确?
* s# s% a9 y5 H% o; U2.如果考虑到输出阻抗的话,那在输入端不是还会有一个分压?3 E. ^5 m; g  T! `
3.有没有直接支持3.3V电平信号转5V 信号,且5V输出这里又有比较大的驱动电流的芯片?" ^- J' W. L, D3 a
+ o' G2 d8 l: m; z( P. f
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    2#
    发表于 2011-6-9 20:27 | 只看该作者
    一般情况下不会采用终端并联端接,用源端串联端接。

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    3#
     楼主| 发表于 2011-6-10 14:16 | 只看该作者
    回复 willyeing 的帖子
    + ]& i0 u3 N9 c4 @" l  \$ D  ]% ]. H* W6 p0 `! S4 \
    明白,但是对面的设备信息如下:
    , G6 }& W! r9 i- ?9 k6 g# s2 H4 P7 [" i3 O
    9 D4 a: |$ Z# u7 b8 |
    input impedance : 50 ohm3 b' u' a6 O2 f/ X, x. U
    input level :HCT
    ; L9 L. ^6 o' m0 t1 _$ E) d; Z
    / f# q7 ]& Q/ F所以没办法。0 g" X( z* V" y9 Q( R5 J' _' ?% G
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    4#
    发表于 2011-6-10 19:59 | 只看该作者
    查查ti网站上有很多这种电平驱动芯片,网站上挂了很多应用笔记,应该有满足你要求的芯片的

    该用户从未签到

    5#
     楼主| 发表于 2011-6-16 16:53 | 只看该作者
    谢谢楼上的回答,在ti上找了一圈,根据驱动电流选了ABT的器件。应该能够满足要求,想知道的是这种SN74ABT16245A的器件输出阻抗一般是多少的。
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