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[仿真讨论] 关于50欧姆终端并联匹配的问题

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1#
发表于 2011-6-9 12:26 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 hgzty 于 2011-6-9 12:48 编辑
  ?% Y2 O9 q- `* u" j' i" S8 G, ?0 b, _* O/ f: l3 w# t6 J
      对面设备是5V TTL的输入标准 VIH:2V,有一个50欧姆的并联匹配电阻接地。信号速率在100M以下。9 g9 S: L. D9 P
, c2 Q8 ?6 N0 p& B* f
       我的设备是这样的情况,cpld输出的是3.3V TTL/CMOS 电平。那就是说如果要能够正常驱动的话,起码要有40mA以上的驱动电流。也就是说我必须设计一个满足5V TTL输出电平又同时满足驱动能力的接口.! z0 s+ ]3 @2 \# V/ q9 l$ P. J& f
7 a; W# Q( s: Q$ R
      现在的想法是,CPLD输出的3.3V电平信号首先通过电平转换为5V TTL,再通过line driver芯片进行驱动。) [, @; A8 U! R7 k  E* W& ]- B

& y- q! b# A2 Z- m$ [     还有一种设计就是CPLD输出的CMOS 3.3V电平信号直接驱动 5V TTL的line driver芯片。 : d- L' K+ \0 I

: r' m* w3 l7 h  M- b3 F2 K, _$ ?) R. x想问一下的就是,( c$ K! D5 P/ E9 `; H$ i% G* f
1.40mA的驱动电流计算是否正确?
1 }- g# U) }9 z/ d$ \2.如果考虑到输出阻抗的话,那在输入端不是还会有一个分压?
- D2 k7 g5 w; P9 E3.有没有直接支持3.3V电平信号转5V 信号,且5V输出这里又有比较大的驱动电流的芯片?
6 X* p3 U9 B9 b
3 s9 k* z4 S8 P8 F
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    2025-4-28 15:02
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    [LV.3]偶尔看看II

    2#
    发表于 2011-6-9 20:27 | 只看该作者
    一般情况下不会采用终端并联端接,用源端串联端接。

    该用户从未签到

    3#
     楼主| 发表于 2011-6-10 14:16 | 只看该作者
    回复 willyeing 的帖子
      k2 A+ v  i$ w" B& Q. _
    2 ~  @% D, V  X: w明白,但是对面的设备信息如下:  d& S# i  n, D, o* w( Q
    . W5 s9 ]$ b3 D7 m

    # d# t. O8 I+ m' Q& x" z" dinput impedance : 50 ohm, {, \& E# ^2 H: p( w8 F0 n3 |
    input level :HCT- c2 D  o  N; c! t4 a* H

    # }$ P6 h, r. p4 z; v' z所以没办法。8 l& }, T$ ]$ W+ E
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    4#
    发表于 2011-6-10 19:59 | 只看该作者
    查查ti网站上有很多这种电平驱动芯片,网站上挂了很多应用笔记,应该有满足你要求的芯片的

    该用户从未签到

    5#
     楼主| 发表于 2011-6-16 16:53 | 只看该作者
    谢谢楼上的回答,在ti上找了一圈,根据驱动电流选了ABT的器件。应该能够满足要求,想知道的是这种SN74ABT16245A的器件输出阻抗一般是多少的。
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