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差分布线一定要等长吗?

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1#
发表于 2011-8-26 11:14 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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差分对 的2根线 一定要等长吗? 还是尽量等长。

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2#
发表于 2011-8-26 11:18 | 只看该作者
尽量等长

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3#
发表于 2011-8-26 11:20 | 只看该作者
本帖最后由 art_li 于 2011-8-26 11:21 编辑
4 ~* L4 W. S9 |5 I# W
. v* v% C. |! F# X+ C既然diff布线,那=长是必须的,一般在5mil 以内~线长一旦不匹配,除了时序上会发生偏移,
0 u" |) K2 o: p还给差分信号中引入了共模的成分,降低信号的质量,增加了 EMI ......

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4#
发表于 2011-8-26 12:17 | 只看该作者
一定要等长,楼上说的很有道理,顶!

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5#
发表于 2011-8-26 13:13 | 只看该作者
等长比平行走还重要。。

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6#
发表于 2011-8-26 13:28 | 只看该作者
一定要等长!

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7#
 楼主| 发表于 2011-8-26 14:05 | 只看该作者
谢谢了,好好学习一下

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8#
发表于 2011-8-26 14:14 | 只看该作者
要等长哦,看你所用芯片的时序,

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9#
发表于 2011-8-26 16:46 | 只看该作者
差分布线有两点要注意,一是两条线的长度要尽量一样长,等长是为了保证两个差分信号时刻保持相反极性,减少共模分量。另一是两线的间距(此间距由差分阻抗决定)要刻意维持不变,也就是要保持平行。平行的方式有两种,一为两条线走在同一层,一为两条线走在上下相邻两层。一般以前者实现的方式较多。等距则主要是为了保证两者差分阻抗一致,减少反射。对差分对的布线方式应该要适当的靠近且平行。所谓适当的靠近是因为这间距会影响到差分阻抗的值, 此值是设计差分对的重要参数。需要平行也是因为要保持差分阻抗的一致性。若两线忽远忽近, 差分阻抗就会不一致, 就会影响信号完整性及时间延迟。供参考。

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10#
发表于 2011-8-27 22:42 | 只看该作者
恩,3楼的说的很好,顶一个

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11#
发表于 2011-9-2 14:49 | 只看该作者
尽量一样长

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12#
发表于 2011-9-2 14:54 | 只看该作者

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13#
发表于 2011-9-2 15:17 | 只看该作者
学习了!
  • TA的每日心情
    擦汗
    2024-5-15 15:49
  • 签到天数: 314 天

    [LV.8]以坛为家I

    14#
    发表于 2011-9-2 17:10 | 只看该作者
            间距不一致虽然会导致差分阻抗发生变化,但因为差分对之间的耦合本身就不显著,所以阻抗变化范围也是很小的,通常在10%以内,只相当于一个过孔造成的反射,这对信号传输不会造成明显的影响。而线长一旦不匹配,除了时序上会发生偏移,还给差分信号中引入了共模的成分,降低信号的质量,增加了EMI。可以这么说,PCB差分走线的设计中最重要的规则就是匹配线长,其它的规则都可以根据设计要求和实际应用进行灵活处理。

    该用户从未签到

    15#
    发表于 2011-9-2 23:51 | 只看该作者
    我们好像是等距比较关注
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