LPDDR5阻抗控制问题

zyf137 · 发表于 2022-3-22 23:14

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LPDDR5阻抗多少，有没有大佬告知一下

hshy · 发表于 2022-3-23 08:42

找主芯片的guideline

zyf137 · 发表于 2022-3-23 11:36

找了好长时间，找不到

pcb设计worker · 发表于 2022-3-24 17:56

64位为例，16组数据控40欧姆，4组时钟控40（有时候时钟走在top面，线宽无法满足40允许控50）和dqs和clk都控80欧姆

zyf137 · 发表于 2022-3-24 22:32

pcb设计worker 发表于 2022-03-24 17:56:21
5 K! b `. \" m9 G- C. m64位为例，16组数据控40欧姆，4组时钟控40（有时候时钟走在top面，线宽无法满足40允许控50）和dqs和clk都控80欧姆

跟LPDDR4一样的分组吗？

句点608 · 发表于 2022-11-4 11:48

各位的大佬，请教下，LPDDR5/LPDDR5X,在封装中有什么特殊的要求吗？

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