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楼主: goodlife1983x
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Allegro芯片中间热焊盘的覆铜问题

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    1#
    发表于 2022-4-21 10:29 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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    本帖最后由 goodlife1983x 于 2022-4-21 10:33 编辑
    * F4 ?% `# U0 W# G$ x# O0 o( e1 O9 z9 `0 t8 l4 d0 o
    论坛有没有高手帮忙看一下,这个封装中间有9个热焊盘,有一张图片是四边的8个管脚是有编号的,是改了原理图和封装才能让8个管脚和覆铜连上AGND,另一张图片是四边的8个管脚只有一个管脚有编号,如果不改原理图和封装的情况下能不能用allegro的设置使覆铜和前面那张图的效果一样,如果强行将四边的7个管脚和那个有编号管脚的网络AGND连接会如图报DRC,并且覆铜也没有自动连上,尝试过改管脚性为AGND或short可以连接上AGND,不报DRC,但是覆铜还是没有那张8个脚都有编号的效果,而且覆铜时和报DRC的效果差不多一样,其它没有编号的管脚属性为< MECHANICAL PIN ># h# @, }5 n- y! D/ y

    5 b0 l+ Y0 Y+ K* v: x6 C
    / k* k$ ?; d: t6 X, z, N) K; l8 s- ~7 Z' }

    0 O) r/ p! k7 w/ X+ p, o, q1 v7 f/ t2 q8 r! l) B
    3 M; L( ?& c- ]/ y! \" B: L% K: S

    allegro覆铜的问题.jpg (97.53 KB, 下载次数: 5)

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    2#
    发表于 2022-4-21 12:11 | 只看该作者
    铺静态铜皮,强连,Waive掉DRC

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    多谢指导,有没有不报DRC错误的方法?  详情 回复 发表于 2022-4-22 08:35
    头像被屏蔽
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    3#
    发表于 2022-4-21 14:03 | 只看该作者
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    4#
    发表于 2022-4-22 00:48 | 只看该作者
    两张图的铺铜效果都不好。上述不是最优的思路。直接用静态铺铜就解决了,铺盖住9个PAD就可以了,干嘛非要铺铜外延呢?

    点评

    多谢指导,用您说的这个方法会不会有报DRC错误  详情 回复 发表于 2022-4-22 08:34
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    5#
     楼主| 发表于 2022-4-22 08:34 | 只看该作者
    leese2002 发表于 2022-4-22 00:48
    & I' Z9 q' G4 V, s) }两张图的铺铜效果都不好。上述不是最优的思路。直接用静态铺铜就解决了,铺盖住9个PAD就可以了,干嘛非要铺 ...
    ( m$ R* r) r5 V  j2 j' C+ G3 i
    多谢指导,用您说的这个方法会不会有报DRC错误/ _9 V: R3 @/ D3 t4 o1 ]) }0 m
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    6#
     楼主| 发表于 2022-4-22 08:35 | 只看该作者
    dzkcool 发表于 2022-4-21 12:117 f# O; _% O) ]6 {( ]: G  o
    铺静态铜皮,强连,Waive掉DRC

    , n; C3 F  a" i多谢指导,有没有不报DRC错误的方法?
    : z; w/ [3 I. S5 @( e8 b
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    7#
    发表于 2022-4-22 08:59 | 只看该作者
    有,改原理图,改封装

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    这个太麻烦了吧,我以为有更加简便的方法!,比如说改焊盘的属性  详情 回复 发表于 2022-4-22 10:55
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     楼主| 发表于 2022-4-22 10:55 | 只看该作者
    dzkcool 发表于 2022-4-22 08:59
    8 m, X" o1 y6 n* C有,改原理图,改封装
    - O1 v# a7 S! b- [' r7 j+ C4 c
    这个太麻烦了吧,我以为有更加简便的方法!,比如说改焊盘的属性
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     楼主| 发表于 2022-4-22 10:59 | 只看该作者
    aarom 发表于 2022-4-21 14:03& ^1 j' R& [* W. v- y. u
    是我,會改零件腳 pin129 使用 shape 建零件腳包括至另7腳, 但pad 的 mask 和 鋼板 不要建, 而要建在其他層 ...

    3 X' g# D- P& h8 s6 R* X多谢指导,我以为allegro有能像PADS那样关联引脚的功能!将引脚关联到同一网络,或用ECO直连想要连的网络3 `0 E0 \5 t, W- i  p9 Q# D

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    你的意思是,8个PAD原来不是AGND网络的,铺铜AGND连接起来产生了DRC,在allegro里面能不能直接把这8个PAD改成AGND网络,铺铜(AGND网络)就没有DRC了,,是这个意思吧。哎。  发表于 2022-4-23 01:09

    该用户从未签到

    11#
    发表于 2022-4-23 01:16 | 只看该作者
    本帖最后由 leese2002 于 2022-4-23 01:48 编辑
    8 {' L+ ~4 i3 g' G  g/ F0 c7 _2 @1 ^1 o: [5 t1 v! C, t$ ]3 W! {
    在allegro里面可以改的,,按以下设置,在Options里面选择要赋予的网络名(AGND),分别点击这8个PAD,
    1 x  r$ W# s" n9 f( P$ @& |, S4 D, L0 y. p8 h1 m# S

    点评

    多谢指导,这个方法是可以连接的,就有点像PADS的ECO功能,但是这个方法好像要有引脚编号属性为PIN的才行,而这7个管脚属性是MECHANICAL PIN没有引脚编号好像不行,是不是除改原理图和PCB封装之外还有其它  详情 回复 发表于 2022-4-23 11:01
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    发表于 2022-4-23 09:12 | 只看该作者
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    13#
     楼主| 发表于 2022-4-23 11:01 | 只看该作者
    leese2002 发表于 2022-4-23 01:16
    ! o% E/ v$ Z7 e0 `在allegro里面可以改的,,按以下设置,在Options里面选择要赋予的网络名(AGND),分别点击这8个PAD,

    0 v0 g9 m+ q' k* S5 V1 c多谢指导,这个方法是可以连接的,就有点像PADS的ECO功能,但是这个方法好像要有引脚编号属性为PIN的才行,而这7个管脚属性是MECHANICAL PIN没有引脚编号好像不行,是不是除改原理图和PCB封装之外还有其它什么方法设置后也可以连接,我单独设置过引脚的属性是能连接,但是发现覆铜覆不上去,还是我的操作步骤有什么地方遗漏了+ v7 i) [4 l4 S
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    14#
     楼主| 发表于 2022-4-23 11:07 | 只看该作者
    aarom 发表于 2022-4-23 09:12
    8 `9 O' @# T& c/ H1 hALLEGRO是可指定,修改線路, 但考慮如下:- ^( A0 b% k6 Q6 f0 y
    1.符合廠商腳位規格.(以後好溝通.)
    6 b5 L8 S. v. f$ ~2.以後修改重吃netlist,不 ...
    0 ?: |1 q2 n  o: ~; g  B! j7 l
    多谢指导,高,实在是高,这样会避免图一时的方便给后续带来更多的麻烦,这个软件的操作确实严谨!技术需要这样的精神!: J3 B' T: X" k0 D7 A  o
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