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关于PADS的使用问题(CAE封装)?

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发表于 2022-9-15 15:31 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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在用pads2007制作CAE封装时,我想做一个QFN-32的处理器封装,但是用“CAE decal warzid" 这个功能做四边形封装时出现了两个问题无法解决:& \7 ~% F$ x( g% t/ k, }
1. 引脚的排列顺序总是与标准的芯片引脚顺序不一致!而且很难调整!如果在管脚排列里一一的修改,实在很麻烦,有没有更好的设置方法呢?1 G! a; I+ J2 C' ~/ i% N* a' M
2.相邻十字交叉的管脚的名字标识总是互相覆盖和叠加在一起,把边框放大后这个问题还是解决不了! 请问有没有更好的设置方法呢?
3 W5 j0 g' H/ t& K$ Y7 o

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2#
发表于 2022-9-15 17:01 | 只看该作者
多多分享实际的例子、有实际用处的。

该用户从未签到

3#
发表于 2022-9-15 17:31 | 只看该作者
如果与标准芯片管脚排列相差很大,建议不要用warzid功能,自己手动设置管脚位置,至于管脚名可以在建立parttype时的edit electrical里定义,很方便的。) F! P9 I# e# ], x9 f

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4#
发表于 2022-9-15 17:35 | 只看该作者
增加pin spacing 的值。
( R7 O" E' M" a  I; `$ M

该用户从未签到

5#
发表于 2022-9-15 17:40 | 只看该作者
手动做比向导快,我从来不用向导做元件,利用重复放置管脚功能,一般做个CAE1-2分钟就OK了,简单的几十秒。
: f0 @& [( I& H  m. f% Q9 C- e
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