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请教:如何能将原理图DE CIS中将FPGA的管脚连接信息导出,给Xilinx的ISE软件?

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1#
发表于 2011-11-28 17:07 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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如题,也不知道发到哪个版面合适,0 l/ M( T- @8 e' x; _8 _% |1 L* T
哪位同学知道,帮忙回复一下。多谢!

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2#
发表于 2011-11-30 09:34 | 只看该作者
我知道联系我 Q 170762386

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3#
 楼主| 发表于 2011-11-30 11:20 | 只看该作者
顶!

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4#
发表于 2011-11-30 14:57 | 只看该作者
试试这个

评分

参与人数 1贡献 +10 收起 理由
aguang963_0 + 10 很给力!

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5#
 楼主| 发表于 2011-11-30 22:40 | 只看该作者
恩,试了一下很成功,也可以像2楼说的那样,1 \' r6 L/ O9 G4 W  @
选中dsn文件,然后tool/expor fpga.
9 A$ [( n2 N5 m$ R+ s$ Q其实二位说的方法都对。( j7 f: C) g0 t( G: m7 R; v; W; S# m" l

- a; e2 @/ p' @再次感谢 yuzengshu,感谢 刚好五个字。
0 l8 ]: w* t  ~8 ^, e3 M
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