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EDA365电子论坛网»电子社区 › 研发技术版块 › 信号完整性SI/PI仿真 › speed2000 DDR3仿真
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[Cadence Sigrity] speed2000 DDR3仿真

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haloooo

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1#
发表于 2022-10-10 17:53 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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仿真小白，使用的毛忠宇老师的书籍操作以及案例和模型，请教下为什么在仿真的最后一部总是会显示仿真失败呢。仿真之前已经经过保存了。( @3 `9 c; \$ t* L2 S
% t% W3 j" j: i5 @, a5 F

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dzkcool
  • TA的每日心情
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    2024-2-21 15:59

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    [LV.8]以坛为家I
    2#
    发表于 2022-10-11 16:04 | 只看该作者
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    haloooo
    哦哦，谢谢老师，解决了以及  详情 回复 发表于 2022-10-12 13:58

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    haloooo

    该用户从未签到
    3#
     楼主| 发表于 2022-10-12 13:58 | 只看该作者
    dzkcool 发表于 2022-10-11 16:04$ q% J, _' D9 K1 G3 A! {8 @2 W
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    哦哦，谢谢老师，解决了以及) A$ O' U* X, h5 J1 w, o7 D; h! |

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