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差分线走过孔就出错

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1#
发表于 2012-2-29 10:10 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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差分线走线在中间层,想打过孔到顶层,但是一大过孔就出错
5 _, Y$ \1 U, p* `) \9 H# h提示 All Maximum Via Count/ ^' {- I: c- P/ j9 v; Z' o( ~& l
好像在差分线的约束设置里没有这个选项吧. G" u# V, i1 U% z2 z3 s
求助~~~

该用户从未签到

2#
发表于 2012-2-29 17:01 | 只看该作者
有的,8 u. m* b% t* \! w
你把allegro constraint manager打开,在NET下 /routing /Vias 里面有个Via count的设定。
4 l' S$ P* W* g$ P你的Via最大数量超过了。

该用户从未签到

3#
 楼主| 发表于 2012-2-29 17:20 | 只看该作者
fune_pcb 发表于 2012-2-29 17:01 7 Z1 }. [/ R/ b5 ]& F: y% M- V2 {  J
有的,
" r) k- H5 X" a$ _你把allegro constraint manager打开,在NET下 /routing /Vias 里面有个Via count的设定。 / v, r+ M8 U- k& q6 O; v# q
你的V ...
4 J8 X- a7 A# U6 W; p4 j& H/ W' U
我现在只想保住你的大腿{:soso_e109:}
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