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EDA365电子论坛网»电子社区 › 研发技术版块 › 信号完整性SI/PI仿真 › 用power si提取DDR S参数的时候出现异常
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[仿真讨论] 用power si提取DDR S参数的时候出现异常

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Devin-G

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1#
发表于 2023-4-11 16:09 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 Devin-G 于 2023-4-11 16:09 编辑 . }) n+ g/ s4 F; }* f
6 P& A1 B' Y7 M$ d( E& g8 W/ q
哪位大佬帮忙解决一下4 M, \6 F; ~3 q1 x+ m
10层板,要提取的DDR这组数据信号走线分别在3,8两层，分别参考的2,9完整地层
% G* z; k" m5 `5 c2 c1 @power si跑完后，3层的走线插损回损都是正常波形，8层走线的信号波形全不正常，无法上传截图大概画一下，黑色是正常的，红色是不正常的1 i6 d% a. V; _2 I/ r8 S7 X7 Y# Y: T

$ V/ s5 Z  Z2 v6 T

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Devin-G

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2#
 楼主| 发表于 2023-4-11 16:09 | 只看该作者
哪位大佬帮忙解答一下

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qawsedfffrr
  • TA的每日心情
    慵懒
    2022-12-12 15:57

    • 签到天数: 6 天

    [LV.2]偶尔看看I
    3#
    发表于 2023-4-11 17:39 | 只看该作者
    有没有可能是你设置的问题，这种结果一眼看上去就不对的感觉就是哪里没设对

    点评

    Devin-G
    嗯嗯，设置问题，检查出来了  详情 回复 发表于 2023-4-12 09:53

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    Devin-G

    该用户从未签到
    4#
     楼主| 发表于 2023-4-12 09:53 | 只看该作者
    qawsedfffrr 发表于 2023-4-11 17:39, f; A) X# c: `; j
    有没有可能是你设置的问题，这种结果一眼看上去就不对的感觉就是哪里没设对

    + u) c8 Z, t5 ?6 U' I) s嗯嗯，设置问题，检查出来了
    . Z- |0 T0 a# |+ u# C/ A2 ]+ E

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