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[Cadence Sigrity] 频率与阻抗关系怎么把控

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  • TA的每日心情
    开心
    2024-4-26 15:04
  • 签到天数: 207 天

    [LV.7]常住居民III

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    1#
    发表于 2023-5-16 08:43 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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    在实际使用中发现,阻抗会受到频率的影响,50Ω的阻抗在1.6G左右的时候测得的阻抗是68Ω,在低频的时候阻抗是贴近50Ω的,在PCB阻抗控制时,怎样计算频率对阻抗的影响
    9 m4 @. \  s! q8 R: X7 ^
  • TA的每日心情
    开心
    2024-10-17 15:51
  • 签到天数: 409 天

    [LV.9]以坛为家II

    推荐
    发表于 2023-5-16 14:52 | 只看该作者
    你的低频是多少频率,怎么会相差这么大,impedance只与trace C和L有关,L随频率一般不变化,主要是C随频率的变化,C随频率的变化也是trace 周围PP/Core DK随频率的变化导致的C变化,但是这个变化是很小的,不可能从68ohm到50ohm这么大的变化呀

    该用户从未签到

    2#
    发表于 2023-5-16 09:24 | 只看该作者
    一般只考虑50Ω,没有考虑各种频率段
  • TA的每日心情

    2025-4-22 15:00
  • 签到天数: 79 天

    [LV.6]常住居民II

    4#
    发表于 2023-5-18 09:29 | 只看该作者
    一般材料会有频变特性,范围都在1~10GHz大概是在0.5左右,偏差怎么会那么大?

    “来自电巢APP”

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