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[Cadence Sigrity] 如何从FPGA的IBIS模型中提取出对应内存控制器的模型

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    发表于 2023-7-27 09:16 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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    本帖最后由 snutqq 于 2023-7-27 09:16 编辑 / Y: \8 p* A" o

    8 g( t( |. S9 J9 P5 u用Sigrity进行DDR3的仿真,控制器端用的是FPGA器件,存储端用的是镁光的DDR3器件。这两个器件都能从官网得到对应的IBIS模型。
    5 B- e" w* B7 v" R# X3 H在sigrity里面进行模型分配的时候,控制器端IBIS模型里面并没有按照DDR3的信号分组进行设置,而是这样的格式内容,请问需要如何操作才能得到像教程里面这样的设置模型?. S! m2 e3 R" U$ r5 N+ J
    不知道有没有哪位大神能不吝赐教,谢谢!
    0 [/ m( y7 |& u4 g" y  k0 }  b

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    发表于 2023-7-27 10:45 | 只看该作者
    要让FPGA工程师输出管脚与信号对应关系表,或者手工对FPGA的模型进行编辑,编辑方法可参考这篇公众号文章:https://mp.weixin.qq.com/s/nmA0S61yYr1RE4QNA7bu3g

    点评

    学习了,非常感谢杜老师解惑。  详情 回复 发表于 2023-7-27 14:28
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    3#
     楼主| 发表于 2023-7-27 14:28 | 只看该作者
    dzkcool 发表于 2023-7-27 10:45
    & G& J9 u& s. Y要让FPGA工程师输出管脚与信号对应关系表,或者手工对FPGA的模型进行编辑,编辑方法可参考这篇公众号文章: ...

    , \% i+ l$ l! W. q' R' F/ Z学习了,非常感谢杜老师解惑。
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