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去耦电容放置在BGA pad的via上DRC检查如何设置不报错

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1#
发表于 2012-5-23 11:24 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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请问这样放置BGA的去耦电容,如何设置才能让DRC不报错?

去耦电容放在BGA pad 的via上.JPG (30.53 KB, 下载次数: 3)

去耦电容放在BGA pad 的via上.JPG

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2#
 楼主| 发表于 2012-5-23 15:30 | 只看该作者
没人帮忙吗?我现在报了一堆PV的问题:'(

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3#
发表于 2012-5-23 22:16 | 只看该作者
DRC模式下设置中关闭相应DRC检测就行了

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4#
发表于 2012-5-24 10:49 | 只看该作者
您的問題應該是 Via on Pad 的問題.; f$ n& j  e; k8 G
通常是不允許的. 如果要不想要有 DRC , 則兩個方式可處理.
" S! u/ G; r" h3 l1. 直接 Waive DRC , 或是下 No DRC 這個 properity , 不過不建議如此操作.$ b0 Q6 q+ d. a( m. |# j
2. 在Constraint manager 中 , 在Analysis mode 裡面去把 SMD pin mode 功能設定出來使用.

Snap1.jpg (41.24 KB, 下载次数: 1)

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5#
 楼主| 发表于 2012-5-24 14:59 | 只看该作者
谢谢你,procomm1722

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6#
发表于 2012-5-24 15:43 | 只看该作者
为啥这么放啊?

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7#
 楼主| 发表于 2012-5-24 15:55 | 只看该作者
BGA间距太小啊,没办法,还是尽量不要把via放pad上

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8#
发表于 2012-5-28 07:16 | 只看该作者
你那三个pin是一个网络的,可以top层走线,然后用一个via,就可以给去耦留个位置了。。。

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9#
 楼主| 发表于 2012-5-28 09:48 | 只看该作者
BGA深度太深,走TOP是没机会了,不知道你们做过没有,是freescale的i.MX53,比较难搞
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