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DC-DC电源芯片下方的内层,好像是要挖的。大家听说过吗?

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1#
发表于 2012-7-6 17:03 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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DC-DC电源芯片下方的内层,好像是要挖的。大家听说过吗?
/ B/ s' w  p4 F$ G5 K如果真的挖了,那回路怎么办呀?1 D. _. c' F  F# p1 M$ B
谢谢指教!!!

该用户从未签到

2#
发表于 2012-7-6 17:09 | 只看该作者
这个有要求么?一般芯片手册上会有注意事项和推荐的layout,按照手册上布局,共地使回路最短就行了吧~注意反馈从输出的电容附近取电,线路干净点就行了~~

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eeicciee + 5 赞一个!谢谢!!!!!!

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3#
 楼主| 发表于 2012-7-6 17:10 | 只看该作者
谢谢沙发同志的解释!!!!
' h$ S" C% b  M

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happyxiaoluohao + 2 支持!合作愉快~~

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  • TA的每日心情
    开心
    2020-1-13 15:12
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    [LV.5]常住居民I

    4#
    发表于 2012-7-6 22:24 | 只看该作者
    电源芯片下面不需要挖空处理,只需要在输入电感下面做挖空就行了哈

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    5#
     楼主| 发表于 2012-7-7 01:24 | 只看该作者
    Christhenghao 发表于 2012-7-6 22:24
    & C# C( p* {/ J5 B  v' d. G4 P6 G6 T电源芯片下面不需要挖空处理,只需要在输入电感下面做挖空就行了哈
    9 Z8 p4 v  Z8 Y. Z# Z. j6 _, V  R
    输出电感呢??????????

    该用户从未签到

    6#
    发表于 2012-7-7 12:17 | 只看该作者
    电感,在底下的ground 与power 层最好能挖空,防止power swithing 的低频耦合至系统.

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    该用户从未签到

    7#
    发表于 2012-7-7 17:18 | 只看该作者
    没听说过,但我的理解是有一种情况跟这个类似,用的QFN封装的,但也不用全部挖空。* J% _- p2 ]4 X0 g
    芯片内部有AGND和PGND,两种地在某一点连接,而在原理图上都命名为GND,需要在Layout时区分。# @3 l3 @6 ~- w8 F+ N
    如果散热盘接AGND,那么其他接PGND的层在散热盘下就要挖空了。

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    eeicciee + 5 还是不太懂。有没有资料可以参考?

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  • TA的每日心情
    开心
    2020-1-13 15:12
  • 签到天数: 31 天

    [LV.5]常住居民I

    8#
    发表于 2012-7-7 20:04 | 只看该作者
    eeicciee 发表于 2012-7-7 01:24
    2 G8 x1 X: Y" ]8 y/ ]' b1 p& O8 Y输出电感呢??????????
    " m" W6 I7 _/ `
    笔误还,我要表达的意思就是输出电感,主要是防止开关频率耦合到系统中。一般电感下面都要做掏空处理,切正下方各层均不走线。DC-DC   layout时一般就注意:1、输入、输出尽量远离 2、反馈回路包地处理 3、有单点接地要求。

    该用户从未签到

    9#
    发表于 2012-7-9 00:42 来自手机 | 只看该作者
    反馈回路包地处理时什么意思?谢谢耐心解答!
    3 k  s, R7 f( P0 ^! B+ Z  C7 I来自:EDA365 硬件设计、PCB设计论坛 Android客户端

    该用户从未签到

    10#
    发表于 2012-7-9 00:57 | 只看该作者
    反馈回路包地很难做到啊,除非你的器件距离都比较远。
    0 |( R' U0 S" I* d; ?- h不明白单点接地是什么要求,不是就近接地比较好吗。

    该用户从未签到

    11#
    发表于 2012-7-9 08:46 | 只看该作者
    其实没啥特别的东西,按照器件手册画就行,有些东西别太较真,/ `: z- Z$ n1 l3 S
    我从没有包过地,也没有啥单点接地,效果一样可以做的很好。/ g. Q$ n( P7 s" m
    ! {& T/ X+ V: e0 N4 T( i
    但是具体应用条件不同,要求自然也不一样,所以这个也不能一概而论。

    该用户从未签到

    12#
    发表于 2012-7-9 16:10 | 只看该作者
    学习了。
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