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PCB中50欧姆射频线,按照微带线还是CPW线来计算阻抗?

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  • TA的每日心情
    开心
    2025-4-23 15:51
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    [LV.5]常住居民I

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    1#
     楼主| 发表于 2024-12-27 17:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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    PCB上50欧姆的射频阻抗线,大家是以什么模型算阻抗的,微带线还是CPW呀?$ n) X5 M0 D  H" C
    好像很多都是按微带线算,但实际射频线周围都有地线或地铜的呀。
  • TA的每日心情
    擦汗
    2024-5-8 15:15
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    [LV.1]初来乍到

    推荐
    发表于 2025-2-6 23:14 | 只看该作者
    scofiled 发表于 2024-12-30 10:03' o' p& J8 d9 [7 f" b
    打了地孔就有地了,那是不是算阻抗的时候,就应该用CPW共面波导的模型来算阻抗了?

    ) R: w/ _0 C; b1、Sub 6G频段以内,PCB单板50欧姆线大多数都有“包地”处理,再配合各种阻、容、感调整匹配,优化各种指标。2、Sub 6G频段以上,频率高,波长短,匹配调试不多。因为波长太短了,调试的话,太敏感了。要靠仿真,以及板材等,保证设计的各项指标。
    8 a" |% D1 P4 u! V
    * V. j9 C& I/ h5 {2 a3、Sub 6G频段以内,50欧姆微带线间距“包地”Shape距离约1.1倍*线宽,比如50欧姆微带线宽1mm,则微带线间距“包地”Shape经验距离1mm~1.2mm。此时底孔对50欧姆阻抗完全可以忽略。' ^5 h/ a! f' a: h

    该用户从未签到

    3#
    发表于 2024-12-27 17:20 | 只看该作者
    用PCB来做50Ω的带线,那就在旁边打地孔啊

    点评

    打了地孔就有地了,那是不是算阻抗的时候,就应该用CPW共面波导的模型来算阻抗了?  详情 回复 发表于 2024-12-30 10:03
  • TA的每日心情
    开心
    2025-4-23 15:51
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    [LV.5]常住居民I

    4#
     楼主| 发表于 2024-12-30 10:03 | 只看该作者
    c384464376 发表于 2024-12-27 17:20
      ]5 u* A8 B4 `, P; @9 b用PCB来做50Ω的带线,那就在旁边打地孔啊
    % {& J6 u% _% P1 q8 ]3 l9 R- X% ^
    打了地孔就有地了,那是不是算阻抗的时候,就应该用CPW共面波导的模型来算阻抗了?

    点评

    1、Sub 6G频段以内,PCB单板50欧姆线大多数都有“包地”处理,再配合各种阻、容、感调整匹配,优化各种指标。2、Sub 6G频段以上,频率高,波长短,匹配调试不多。因为波长太短了,调试的话,太敏感了。要靠仿真,以  详情 回复 发表于 2025-2-6 23:14
  • TA的每日心情
    慵懒
    2025-8-13 15:41
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    5#
    发表于 2025-4-1 11:11 | 只看该作者
    看看      
  • TA的每日心情
    擦汗
    2025-8-7 15:04
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    [LV.5]常住居民I

    6#
    发表于 2025-5-17 15:48 | 只看该作者
    只知道匹配仿真,还没参与线

    该用户从未签到

    7#
    发表于 2025-6-5 22:54 | 只看该作者
    我也有相同的问题。不晓得怎么插入图片。也不能插入我的连接。我也在这板块发个主体贴出图片讨论下。

    该用户从未签到

    8#
    发表于 2025-8-7 16:34 | 只看该作者
    50欧姆带线
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