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[仿真讨论] PCIE3.0阻抗是100欧姆,PCIE4.0是85欧姆,要是4.0向下兼容的话,整个链路的阻抗控...

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1#
 楼主| 发表于 2025-1-2 16:40 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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PCIE3.0阻抗是100欧姆,PCIE4.0是85欧姆,要是4.0向下兼容的话,整个链路的阻抗控制多少合适,有碰到的不,感谢感谢感谢!; q* A% o- [8 d
  • TA的每日心情
    擦汗
    2024-5-14 15:27
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    [LV.1]初来乍到

    2#
    发表于 2025-1-2 16:53 | 只看该作者
    85,另外我之前3.0阻抗也是做85的。

    点评

    不会算。当时几个项目的PCIE3.0都是走85欧的,当然焊盘和过孔进行了优化。最后板卡在设备上速率ok,使用仪器测量速率可以达到90多  详情 回复 发表于 2025-1-3 09:49
    大哥能幫算一下 85欧姆 偏下限, 對 PCIE3.0阻抗是100欧姆誤差 的影響嗎??  发表于 2025-1-2 19:08
    头像被屏蔽
  • TA的每日心情
    开心
    2025-1-23 15:05
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    [LV.4]偶尔看看III

    3#
    发表于 2025-1-2 18:22 | 只看该作者
    提示: 作者被禁止或删除 内容自动屏蔽
  • TA的每日心情
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    2024-5-14 15:27
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    [LV.1]初来乍到

    6#
    发表于 2025-1-3 09:49 | 只看该作者
    wen11902 发表于 2025-1-2 16:53' q4 P* b+ p1 F; W) r4 p
    85,另外我之前3.0阻抗也是做85的。

    ' A. c: h2 n$ _' E& W- k) e; d4 ?不会算。当时几个项目的PCIE3.0都是走85欧的,当然焊盘和过孔进行了优化。最后板卡在设备上速率ok,使用仪器测量速率可以达到90多$ i# [' u: a# S  e" ?$ I
  • TA的每日心情
    开心
    2025-6-5 15:42
  • 签到天数: 84 天

    [LV.6]常住居民II

    7#
    发表于 2025-1-3 15:25 | 只看该作者
    pcie tx/rx: 85ohm.
    ; s6 c" a0 s$ E* e% j: {1 x5 d- Ypcie clk: 100ohm.
    $ `: B: n9 C5 K5 O& p! |

    点评

    又一個不會算誤差的.  发表于 2025-1-3 21:14
    头像被屏蔽
  • TA的每日心情
    开心
    2025-1-23 15:05
  • 签到天数: 17 天

    [LV.4]偶尔看看III

    8#
    发表于 2025-1-4 06:09 | 只看该作者
    提示: 作者被禁止或删除 内容自动屏蔽
  • TA的每日心情
    郁闷
    2025-5-8 15:28
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    [LV.5]常住居民I

    9#
    发表于 2025-1-4 09:05 | 只看该作者
    PCIE信号,Gen2:跑5Gbps时,协议的要求比较宽,走线阻抗可以在68-105ohm之间,Gen3:跑8Gbps时,只能在70-100ohm间,Gen4:16Gbps时,只能在72.5-97.5ohm。这个根据需求,有些官方手册写的是多少就按那个demo文件搞就行了,没有手册啥的资料向下兼容一般PCIE控85ohm,就行了。

    点评

    教科書網址: https://www.ednchina.com/technews/25402.html, 假如實戰如教科書, 就不會這樣多人有異問了, 各各寫書老師, 都是科技新貴了, 不用寫書教人了.  发表于 2025-1-4 12:46
    照書讀的不錯, 少說了+-12%阻抗誤差, 及因為走線及疊構的不同, 才無法依照教科書, 要每次模擬和實測.  发表于 2025-1-4 12:31
  • TA的每日心情
    慵懒
    2025-6-6 15:06
  • 签到天数: 592 天

    [LV.9]以坛为家II

    10#
    发表于 2025-2-3 17:04 | 只看该作者
    谢谢分享,顶

    该用户从未签到

    11#
    发表于 2025-2-11 15:49 | 只看该作者
    感觉没那么严格,均衡器一般可以把眼图睁开
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