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[Cadence Sigrity] Power DC IR Drop 仿真报错

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 楼主| 发表于 2025-1-7 16:21 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 LSF005 于 2025-1-7 16:48 编辑
7 Q/ `% X% m/ T! C) j  A! X  e# \6 L9 O+ K7 }2 O
各位前辈,求救,软件版本sigrity 2024版本导入allegro17.2的PCB进行 PowerDC (使用 Single-Board Current-limited IR Drop Analysis )仿真报错:WARNING [Open Net]: Net GND contains two or more disconnected sections, "Split Open Net" in "Net Manager" to check the detail sections,检查了网络和端口都没有问题,实在找不出问题所在,使用Single-Board/Package lR Drop Analysis时进行仿真时是可以正常使用

该用户从未签到

3#
发表于 2025-1-20 13:55 | 只看该作者
在Net里面尝试一下把GND Split一下,然后勾选你参考的那块GND,重新仿真试试看。
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