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求等长线的长度改如何计算?

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发表于 2012-9-21 09:34 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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求等长线的长度改如何计算?是否有资料可以看看?

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2#
发表于 2012-9-21 10:51 | 只看该作者
問題不是很清楚啊 什麽等長?DDR  還是DIFF 什麽什麽啊

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3#
 楼主| 发表于 2012-9-21 13:54 | 只看该作者
xjlovex 发表于 2012-9-21 10:51 $ \/ z: r: }  w% ~$ {1 H$ N* q& T
問題不是很清楚啊 什麽等長?DDR  還是DIFF 什麽什麽啊
4 ?- K5 r: b% i' F
DDR2的数据地址时钟这些在做等长的时候,这个长度是如何计算出来的,有没有什么公式?

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4#
发表于 2012-9-21 17:22 | 只看该作者
gdli 发表于 2012-9-21 13:54
, I; g9 p( i- @& M; v0 w6 ~: SDDR2的数据地址时钟这些在做等长的时候,这个长度是如何计算出来的,有没有什么公式?
+ {3 C8 ?/ u; Q
沒有Guidelines可看么·

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5#
 楼主| 发表于 2012-9-22 08:38 | 只看该作者
xjlovex 发表于 2012-9-21 17:22 3 k+ r: O8 r6 y- s% E
沒有Guidelines可看么·

& ]- H0 Z3 h/ R3 X$ k; s# q这个图吗但是上面说的不明白啊DQ和DQS加载8inch,这个也太长了吧实际的只有1500Mil的

未命名1.JPG (25.23 KB, 下载次数: 0)

未命名1.JPG

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6#
发表于 2012-9-22 14:01 | 只看该作者
gdli 发表于 2012-9-22 08:38
* @1 K1 S) }. g) g) C+ v这个图吗但是上面说的不明白啊DQ和DQS加载8inch,这个也太长了吧实际的只有1500Mil的
5 o2 s% I3 F3 P7 A' ^
这个8INCH 我想应该是指在8000MIL之内吧

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7#
发表于 2012-9-22 14:02 | 只看该作者
比如第一个说的DQS/N 在BREAKOUT 中不能大于500

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8#
发表于 2012-9-22 15:06 | 只看该作者
我觉的这个图的意思是:对于DQS/DQSn从BGA引出的长度最长为500mil,然后加匹配电阻,对应图中用A表示传输线段;匹配电阻到DDR2的B段对应DQS/DQSn leed in DDR2,长度最长为8000mil,DQ的意思和上面相似,分别定义了BGA到匹配电阻RS对应的C和RS到DDR2的D的最大长度,另外说明了DQS和DQSn的最大失配长度为40mil,DS总线之间的最大失配长度为100mil(各DQn之间);DQ和DQS线和CLK/CLKn之间的最大失配长度为600mil;不知道说明白了不

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9#
 楼主| 发表于 2012-9-23 11:46 | 只看该作者
yangyabo02 发表于 2012-9-22 15:06 * T/ `7 y  d4 ]  I7 _+ m
我觉的这个图的意思是:对于DQS/DQSn从BGA引出的长度最长为500mil,然后加匹配电阻,对应图中用A表示传输线段 ...
" w) K9 m" a) `. j: H# n
不明白你的这么多都是和CLK/CLKn来比较的,但是CLK/CLKn该设置多长走线呢又是怎么计算的?

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10#
发表于 2012-9-24 11:16 | 只看该作者
gdli 发表于 2012-9-23 11:46
" E( E1 ^8 P5 w8 D3 C( h4 O2 O不明白你的这么多都是和CLK/CLKn来比较的,但是CLK/CLKn该设置多长走线呢又是怎么计算的?

( {/ l5 r+ Z4 Y1 [1 L+ `DDR2的布线分成两组,时钟、命令、地址组,和数据组,时钟、命令、地址有他们自己的拓扑结构和走线长度的控制方法,你应该参考改组的走线指导,这两组之信号需要组内做匹配以及组间作匹配。你说的和CLK/CLKn比较其实应该是两组之间的匹配,至于CLK怎么走线应该还有CLK的指导,一般是T型拓扑

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 楼主| 发表于 2012-9-25 09:11 | 只看该作者
yangyabo02 发表于 2012-9-24 11:16
7 u# H" ^) Y. ?9 KDDR2的布线分成两组,时钟、命令、地址组,和数据组,时钟、命令、地址有他们自己的拓扑结构和走线长度的 ...

, }# B1 @( p- w; A2 h我意思是讲Layout Guide上说最长8inch,实际画板的时候这个长度我该画多长,有没有计算公式?是怎么算出来的?比如CLK/CLKn画板时做多少Mil

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12#
发表于 2012-9-25 10:33 | 只看该作者
gdli 发表于 2012-9-25 09:11
" x2 P& P5 a/ f) F我意思是讲Layout Guide上说最长8inch,实际画板的时候这个长度我该画多长,有没有计算公式?是怎么算出来 ...

4 |7 S+ \9 r1 O这个问题我是这样认为的:一般走线都是先把所有的线拉通知后再做等长调节,你在调节组内等长时,同时应该考虑组间的长度是否在要求的匹配范围之内。比如:你调整后数据组的长度是5000mil,而你的时钟组的长度是4000mil,如果你无法进一步缩短数据组的长度,你只能调整你的时钟长度了,把时钟做长。这个长度是无法事先计算出来的,每一个板子都是不一样的,只要所有的长度在最大长度范围内,组间长度也没有超标就是可以的。

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13#
 楼主| 发表于 2012-9-28 09:23 | 只看该作者
yangyabo02 发表于 2012-9-22 15:06
  l, Z0 _0 f3 h) V* [) C( y  e我觉的这个图的意思是:对于DQS/DQSn从BGA引出的长度最长为500mil,然后加匹配电阻,对应图中用A表示传输线段 ...
7 G+ {$ f; g2 X1 u& n* r2 n( u
多谢解释的很好,可是有一点不明白,DQ和DQS线和CLK/CLKn之间的最大失配长度为600mil这样是不是误差太大了啊,论坛内的帖子都是说DQ和DQS线和CLK/CLKn误差控制在100Mil以内的啊如果做600的误差是不是有问题呢
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