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EDA365电子论坛网»电子社区 › EDA工具&PCB设计 › Cadence Allegro论坛 › 阻抗控制问题
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阻抗控制问题

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tllok

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1#
发表于 2012-11-30 17:19 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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x
各位大侠请指教！" r- ~# f8 Q' p" }( d
我的差分信号线走在顶层，但我的第二层为sig1层，第三层为gnd层，
2 W4 A7 H7 g. V2 y7 D: N但我的sig1层没有给差分对提供参考铜皮，" m: }9 j$ D3 \
再做阻抗控制时可不可以让板厂把GND层作为参考层？关于阻抗我懂得甚少！！！

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ying9621

该用户从未签到
2#
发表于 2012-11-30 17:26 | 只看该作者
实在不能改叠层的话4 f0 e- J  p& `% V
顶层线改走在第二层吧  ( g5 s8 p/ q/ n" T5 S! Q! ~
顶层少走线  走短线 多铺地 做第二层的参考平面% Y, N2 }9 R* M5 o
你这样走不行噢 ' X, n, k$ o2 B5 \# C
叠层是不是有问题! f1 z# W6 O3 P, G& ^1 y* b" }
参考叠层 ' F3 Z( p! M% j
TOP
' o5 @. p/ P& H0 z& WGND026 C' W9 e4 g6 y8 j' X
ART03....
0 w" x, K+ x3 _7 Q) P...+ G6 y" ^5 D2 ~% B" K! r8 a
." W* K% J4 }' ]7 z

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Caroline

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3#
发表于 2012-11-30 18:48 | 只看该作者
可以的，制造商都可以做到的，相当于参考面增大。

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tllok

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4#
 楼主| 发表于 2012-12-4 13:25 | 只看该作者
非常感谢
( @( X6 Y+ c( w  ^

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