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智能手机6层一阶HDI板的叠层分析

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1#
发表于 2013-1-24 19:19 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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一个好的叠层设计可以使PCB板的性能得到更好,在当前智能机竞争日益激烈的市场下,作为一家方案公司,成本无疑是生存下来的重要因素,而作了一个主打低成本的智能机方案,我想应该以六层板走线居多,在此想请教一下各位同行的经验,对于一个高密度的六层一阶HDI板该如何叠层才最佳?我们知道六层HDI常见的有以下两种叠层方式:
3 d, {+ D" B2 o方案1                                        方案2$ A' @" y: e$ V, r% n2 f1 ?3 P
S1                                              S1
6 L/ x: ?! v4 QGND                                          GND3 u: R6 {* r% `+ Z: ?! [0 ]' e
S2                                             S2
+ q+ P- X" \. E9 h- JGND                                          POWER
0 }9 S# o$ z1 ]POWER                                     GND
6 x6 J* C% b+ C# |9 C% ^( P8 zS3                                             S3
: Z( {" @) }( M1 }7 u" m1 N" ^3 r& J0 Z' z
个人觉得这两种方式都是很难实现的,对于高密度的HDI板,兼容各项功能不说,目前都做断板,由于受到电量的限制,智能机里面,电池都追求做到更大,同时整机高度又不能太厚。对于我们LAYOUT来说,压力很大,目前我们的叠层是:# C. Q" @! V0 t& ~% Z8 Z- X. W

1 z4 n2 \$ c& i7 ZS1   ---------------走高速、表层线
; Q# S! E. @) d5 MS2  ----------------走高速、数字线
4 M  m$ h0 p& v6 J' dGND---------------主地9 B  }+ h1 B2 b
S3------------------走关键线、低频
' i7 g% F* l: X$ W7 gPOWER-----------走电源线
+ ~2 Z- n+ F, |; d8 m, YS4------------------走表层线、数字线
% f- i5 E. f. ^+ M7 |+ @6 H7 N* p& o- {
按目前的这种布局,六层板,S2\S3\POWER层基本会走满,S1/S4表层线,尽量少走线,以增大整个地回流。; p& J7 U3 O& f( E: X+ T. `4 n2 u9 g
不知道各位老师对这种叠层有何看法?有没有更好的叠层建议,可减少EMI干扰?

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2#
发表于 2013-1-25 09:24 | 只看该作者
要控制成本的话,这个看怎么样喽:
! R5 G( X  j. B3 G  T% R; B, K  d****************************
: n% M+ q3 A& H0 O8 c  ETOP
9 {# x% G1 f5 s" I( h2 P& h& g9 qGND
2 \+ P1 S7 w6 D, z/ uS3
: k# p9 x" h# G& _) W/ }9 |, g7 g2 ES4. `6 G# c- d5 {3 e
PWR
$ y# P% m8 N4 {2 g* a$ H8 JBOTTOM$ Z5 J2 q# p/ `2 k
******************************
4 X0 \# u- S2 A4 I8 D$ L手机板的话,顶底层没有多少走线空间了。

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3#
 楼主| 发表于 2013-2-26 20:02 | 只看该作者
hqg 发表于 2013-1-25 09:24
+ h; n1 B- J% ^# z: [- n& A要控制成本的话,这个看怎么样喽:
# \, ?7 r3 T1 e) Q+ w5 E4 b****************************
9 g2 ^6 _5 m' KTOP

4 m, |6 w! h  d这种叠层,1.是否会增加很多埋孔?2.关键信号线走哪层?L3?,结果会更好吗?3.对于六层板,我们采用的肯定是一阶HDI

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4#
发表于 2013-3-6 16:35 | 只看该作者
S1   ---------------走高速、表层线
# v5 Z0 w! K# D9 `3 ?' mS2  ----------------走高速、数字线& S9 E+ _' \) W& m& P3 w' e% ]/ G! T6 m4 e5 c5 l
GND---------------主地, d1 }: ]2 f) i0 J7 u3 ]) J- `
S3------------------走关键线、低频
- M  Y" U" s+ z, U' L6 F3 gPOWER-----------走电源线
+ ~6 p. S/ [! ^5 Y2 H. TS4------------------走表层线、数字线8 S
8 q4 \7 D* K' u# v1 B/ g一般按这种方式走,过孔数量最少,重要信号灯线屏蔽最好,阻抗线有参考地,不过表层最好是要少走线

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5#
发表于 2013-3-19 10:02 | 只看该作者
S1+GND" `3 E1 A9 X, C( {: N) K' a
S2& ]  i& k& {: u. k
GND6 v( q; Q! L3 J; @* v$ d
S4+POWER
  z3 l& V7 R9 `' {: W7 RS5& |5 h* L7 N3 b" i" n- J  q0 T
S6+GND
( m$ x/ O$ ^# L& u7 g+ r3 U% {. O: H$ ?# f" z! |7 T- z
表层尽量少走线,电源与地相邻。

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6#
发表于 2013-3-19 11:02 | 只看该作者
本帖最后由 joshcky 于 2013-3-19 11:04 编辑 ; n, @) ]: w9 s$ r; m. c3 t* i
: G! l% @! S! a- U+ t
没那么多讲究,把问题复杂化了,一层完整的地就OK了,主要是提供给RF那块做参考或保护# D5 H+ K7 t: L! }  h) ^

9 Y7 X& u! y( Y- W至于静电保护,EMI 控制,只要在器件选料或相关EMI的保护,也就所谓的成本考量了.
9 }" ?6 }" m( o5 y
" [$ O9 i8 {2 `0 Y, n+ I2 }本来智能机的布线是MINI化了,空间局限得很. 做好相关重要线的保护.
0 v" I3 C' I( J. v1 m9 H  B7 O6 F9 s" t5 @0 D2 @+ _0 q& K( F' O
结构上多考量,就可以了.8 R2 ^) B! l. Q' q5 i8 O$ f
  v: U3 ^; k- U* X9 i3 z
IPHONE那种属于无级板型,层与层任意贯通。工艺上也是一大输出成本.

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7#
发表于 2015-12-2 18:10 | 只看该作者
二楼的方案我表示无解

点评

怎么个无解?  发表于 2019-3-20 10:41
  • TA的每日心情
    奋斗
    2024-1-4 15:22
  • 签到天数: 88 天

    [LV.6]常住居民II

    11#
    发表于 2022-1-5 10:51 | 只看该作者
    BGA芯片走6层一阶,BGA芯片外围走第一层差分,里面走的是第二层线,那第一层差分线的阻抗怎么控制?
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