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VERIBEST 就是现在的WG,呵呵。 allegro VS VERIBEST
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长度匹配的布线实现: Allegro―〉手工的方法;Veribest―〉成批量地自动完成(可以将设计时间从2周或更长到缩短几个小时)
. x% Q' z* Y5 a; y) }- c3 V多线并行布线: Allegro―〉一次只能完成一根线;Veribest―〉一次可以多根线并能自动调整,打过孔等等(可得益10倍以上的设计效率的提高) 1 H7 \( u; n; \9 K' q& p$ g
动态推挤(调线): Allegro―〉有限的能力(比如出现毛刺);Veribest―〉 随意推挤没有毛刺(5倍以上的效率提高) 8 a( p3 e8 h9 q$ Y: F7 d" U
差分对布线: Allegro―〉 无 ;Veribest―〉可自动差分布线(手工布线下10倍以上的效率提高) + h6 {: j0 A6 _) I- O
无限次的Undo和Redo Allegro: Allegro―〉无Veribest―〉可缩短总设计时间的10% 3 w$ e8 g* P& t1 p4 {! V, t
集成的库管理: Allegro―〉功能有限;Veribest―〉需很少的数据切换
+ I9 Y" X: X- c% U) V原理图和PCB的集成: Allegro―〉基于网表的;Veribest―〉无缝集成(更出色的ECO和BOM,100倍的设计改进) * {7 H/ G% q9 w3 n
中文输入: Allegro―〉不支持;Veribest―〉原理图中输入中文,PCB任意位置任意层输入中文,支持全部字体
& G8 b& z. K5 T' j3 V* Z使用Veribest的酷功能
. t- @$ D2 X. \( |% ?* ~1. 差分对/多线布线
& L' z. m+ g) w2. 高速网线的动态调整(比如可以调整或推挤蛇形线,而蛇形线的形状和长度可以动态的保持不变)
& u r. y' B' t4 D8 p4 h9 x3. 可以敷铜区中进行布局布线,并可以在已敷铜区域内推挤布线、过孔,移动器件 6 `) } a" M8 o' J& G
4. 在一个集成环境下的单一layout设计系统(交互布线与自动布线统一环境)
2 _0 K" ]2 _, E1 \- J- }5. 基于形状的交互布线和自动布线
$ Y$ D8 F& |+ n' P. H( E9 N6. 动态改变线宽和过孔大小的规则区域定义; 2 T+ u6 g# s2 ^2 T
7. 能将电路从一边推挤到另一边 t; \. q! U6 T- b. k
8. 能将过孔合并到其他过孔和引脚; 7 ]5 ^ p* l8 a/ Y& X( ?# `( S! c
9. 敷铜区易于编辑、拷贝和移动;
3 H+ s/ N! a+ @# P: T: ]4 L% N10. 器件在动态敷铜区的移动;
) o' D. z4 p& T& e11. 提供BGA扇出模板;
. O# c' O, L4 f( _- c8 V; K12. 可以显示引脚号;
: V: Z8 X1 J2 }+ }* g! A, h! z/ c13. 动态“冒险”显示; ! w: L( n: F8 k
14. 动态曲线调整(高速约束线); 2 I: C5 e3 B$ g7 d b6 ~ e+ L8 L
15. 钻孔显示; % F. k6 S, h: A$ I1 M7 C' F
16. 多线布线和多线自动连接; s& P z, G* o7 S$ v: T# ^8 c9 g
17. 选择能力(特别是被选中的网线固定); 1 n& y6 P. i% G4 B' n) j
18. 差分对自动调整; 8 K5 c; @1 o) v% \5 W$ Q
19. 动态自动调整;
9 ^; [! J+ p* C( g0 G" G/ H20. 按网线/错误着色;
# b! m8 h" `% g$ d. s) {21. 自动的热焊盘旋转;
1 |: ?* b8 p) s* ?22. 丝印字编辑;
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