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EDA365电子论坛网»电子社区 › 研发技术版块 › 信号完整性SI/PI仿真 › Simulation is failed!
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[Cadence Sigrity] Simulation is failed!

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Dandy_15

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1#
发表于 2013-11-12 14:24 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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同样文件，同样的操作方法，在ASI16.62中能仿真，在ASI16.61中就不行，为什么呢？9 L- Y$ [2 f! J& T( [! \& f
ASI16.62:64bit WIN7
# n; d, X7 z/ t0 J6 v, T4 `ASI16.61:32bit XP: `0 ]2 C! g  k3 c# Q. ~9 w# h
$ K- u/ T7 N) P3 K& g& c6 v! v
提示：! H1 t' t, E) u; F2 e
Simulation is failed!
9 X: o+ S" @  Z; Q) |' _+ `/ [9 A( J# _0 N  r
NET Simulation Error:
' |+ Y. J" I1 rError 2029: "File" not specified for IBIS model "BEAD.EndPartialCkt"0 ~) j' Q4 M' E
0 ], z/ e: y1 B. {" d/ R; X9 H

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Dandy_15

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2#
 楼主| 发表于 2013-11-13 16:28 | 只看该作者

% {3 r1 a$ t% h. I, h/ q4 N7 r: M# H问题已经解决了，用TXT格式打开.sdp文件，修改网表。4 L# e% n4 \: O9 Q4 _) ^7 P6 {
将BEAD.EndPartialCkt改为.EndPartialCkt就可以了

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