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EDA365电子论坛网»电子社区 › 研发技术版块 › 信号完整性SI/PI仿真 › Simulation is failed!
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[Cadence Sigrity] Simulation is failed!

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Dandy_15

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1#
发表于 2013-11-12 14:24 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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同样文件，同样的操作方法，在ASI16.62中能仿真，在ASI16.61中就不行，为什么呢？: D/ A5 P' C; ~9 N- _
ASI16.62:64bit WIN7$ z6 L2 J% s8 ]4 L4 n
ASI16.61:32bit XP
0 z* X3 z3 C; d+ F& |* q% }* t/ K! Q+ @
提示：7 U( O4 T/ m3 e; `  ?) v! g
Simulation is failed!
% ]" n. H2 }( l2 R8 f/ E  H6 l% z) d( n
NET Simulation Error:
/ D7 K3 s6 L& f) u0 u) p3 wError 2029: "File" not specified for IBIS model "BEAD.EndPartialCkt"
8 z/ t2 [; L4 R  H7 `& [6 `0 \8 V& ^& n, R- s

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Dandy_15

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2#
 楼主| 发表于 2013-11-13 16:28 | 只看该作者

8 K3 u2 b2 d% z0 y问题已经解决了，用TXT格式打开.sdp文件，修改网表。
; |% n! b5 w9 w将BEAD.EndPartialCkt改为.EndPartialCkt就可以了

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